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基于VHDL语言的8路抢答器控制系统设计

：EDA技术的应用引起了电子产品系统开发的革命性变革。利用先进的EDA 工具，基于硬件描述语言，借助CPLD(复杂的可编程逻辑器件)．可以进行系统级数字逻辑电路的设计。本文以8路抢答器为例，介绍了在Max+plus II开发软件下，利用VHDL语言设计数字逻辑电路的过程和方法

2022-04-13 10:33:31 141KB 8路抢答器控制系统 EDA CPLD VHDL

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verilog，VHDL转换工具

通过简单的操作，实现verilog和VHDL文件之间的相互转换！

2022-04-12 22:52:49 6.91MB verilog vhdl 转换工具

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VHDL转Verilog工具.rar

硬件描述语言是硬件设计人员和电子设计自动化工具之间的界面其主要目的是用来设计文件建立电子系统行为级的仿真模型即利用计算机的巨大能力对用或建模的复杂数字逻辑进行仿真然后再自动综合以生成符合要求且在电路结构上可以实现的数字逻辑网表 ??????? 根据网表和某种工艺的器件自动生成具体电路然后生成该工艺条件下这种具体电路的延时模

2022-04-12 22:34:19 19.93MB FPGA VHDL Verilog HDL

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BCH码的VHDL实现

希望对大家的学习，有用，给大家带来方便！自己的工作可能不是很好，望大家指正

2022-04-11 23:29:02 470KB VHDL

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基于VHDL汉明码编码器与译码器的设计与实现

毕业设计中对于VHDL语言汉明码编码器与译码器的设计与实现的加深

2022-04-11 23:00:11 593KB 汉明码 编码器 译码器

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VHDL 数码管显示

这是一个基于VHDL语言的FPGA的程序。它的的功能十分强大。可以同时显示6位数据，而且可以设置定显示那位显示和那位闪烁。

2022-04-11 21:03:03 1014B VHDL 数码管显示

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VHDL语言的数码管显示程序

用四个七段式数码管显示数据，实现动态显示，改变分频系数，可以实现不同的显示效果。

2022-04-11 21:01:10 3KB FPGA VHDL 显示

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VHDL全加器仿真程序代码

全加器仿真程序代码，本人亲测无毒安全，放心下载使用。

2022-04-11 15:47:50 626B VHDL

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VHDL实例源代码电子狗，数字钟

VHDL的一些实例源代码，有密码锁，电子狗，数字钟

2022-04-11 15:31:00 1.57MB VHDL实例源代码

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VHDL实用教程[完整版]解析

2022-04-11 14:07:14 2.79MB fpga开发

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