在基于CCD的微机测谱系统的总体方案中,需要对CCD进行选型并设计其驱动电路。在这样的课题背景下,首先研究了CCD的基本原理,然后根据设计要求选择了线阵CCD-TCD1208AP,并给出了其驱动电路的设计方案,最后对设计进行了仿真。

要介绍利用MaxplusII软件来实现VVVF控制SPWM变频调速的方法。设计中提出一种三相分时运算思路,详细阐明其具体实现方式。试验证明,CPLD应用于变频调速系统控制是非、常有效的,使用分时复用电路大大减少了CPLD使用逻辑门的数目。

1.LED的妙用。2.当存在调用大分频元件时的仿真。3.串口的作用。

多摩川绝对值编码器CPLD FPGA通信源码（VHDL格式+协议+说明书） 用于伺服行业开发者开发编码器接口，对于使用FPGA开发电流环的人员具有参考价值。 适用于TS5700N8501,TS5700N8401等多摩川绝对值编码器，波特率支持2.5M和5M

FSMC接口写FPGA通信 为STM32程序 PPS_NEW 为FPGA程序 软件版本Quartus II 14.1

CPLD/FPGA是目前应用最为广泛的两种可编程专用集成电路（ASIC）， 特别适合于产品的样品开发与小批量生产。本书从现代电子系统设计的角度出发，以全球著名的可编程逻辑器件供应商Xilinx 公司的产品为背景，系统全面地介绍该公司的CPLD/FPGA 产品的结构原理、性能特点、设计方法以及相应的EDA工具软件，重点介绍CPLD/FPGA在数字系统设计、数字通信与数字信号处理等领域中的应用。   本书内容新颖、技术先进、由浅入深，既有关于大规模可编程逻辑器件的系统论述，又有丰富的设计应用实例。对于从事各类电子系统（通信、雷达、程控交换、计算机等）设计的科研人员和应用设计工程师，这是一本具有实用价值的新技术应用参考书。本书也可作为高等院校电子类高年级本科生或研究生的教材或教学参考书。   随着电子技术的不断发展与进步，电子系统的设计方法发生了很大的变化，传统的设计方法正逐步退出历史舞台，而基于EDA技术的芯片设计正在成为电子系统设计的主流。大规模可编程逻辑器件CPLD和FPGA是当今应用最广泛的两类可编程专用集成电路（ASIC），电子设计工程师利用它可以在办公室或实验室里设计出所需的专用集成电路，从而大大缩短了产品上市时间，降低了开发成本。此外，可编程逻辑器件还具有静态可重复编程和动态在系统重构的特性，使得硬件的功能可以像软件-样通过编程来修改，这样就极大地提高了电子系统设计的灵活性和通用性。   由于具备上述两方面特点，CPLD和FPGA受到了世界范围内广大电子设计工程师的普遍欢迎，应用日益广泛。与此同时，可编程ASIC本身也在近几年得到了迅速的发展，其集成度、工作速度不断提高。目前已有单片可用门数超过300万门。工作频率可达200 MHz以上的可编程ASIC芯片问世。由于结构和工艺的改进，可编程ASIC芯片上包含的资源越来越丰富，可实现的功能越来越强，它们已成为当今实现电子系统集成化的重要手段。   Xilinx公司是全球著名的可编程逻辑器件供应商，也是FPGA器件的发明者，它在多年用户需求的基础上开发了多种性能优越的系列产品，其售后服务周全，用户涉及面广，是开发和研制产品的最佳选择之一”。 本书以Xilinx公司的产品为背景，系统介绍该公司的CPLD和FPGA典型产品的结构原理、性能特点、设计方法以及相应的EDA工具软件，详细介绍Foundation Series 开发软件的特点、安装和使用方法，重点介绍CPLD/FPGA在数字系统设计、数字通信与数字信号处理等领域中的应用。除此以外，还对JTAG边界扫描测试电路以及硬件描述语言VHDL的基本概念作了简要的介绍。本书在选材上注重内容新颖、技术先进，并在书中给出了经实践验证的大量设计实例，希望能对读者迅速掌握大规模可编程逻辑器件设计与应用有所帮助。同时，为保证书中实例不受具体器件限制，本书所有实例均采用VHDL语言或Verilog HDL语言编写，可以方便地移植到其他公司（如Altera、LarTIce、 Actel 等）的CPLD/FPGA器件中。

本文介绍了ZYNQ芯片的裸机编程方法，包括硬件平台的搭建、裸机程序的编写、调试和优化等方面。作者详细讲解了ZYNQ芯片的架构和寄存器的使用方法，并给出了多个实例，帮助读者深入理解ZYNQ芯片的裸机编程。本文适合有一定FPGA开发经验的工程师和学生学习。

本模块主要是ADC采集信号波形进行峰值检测，主要是检测单音信号或者脉冲信号中的所有峰峰值信号（对噪声大信号适用性不是很好），并记录峰值点的位置； 主要是对并行数据排序处理，本例程是处理 2Gsps adc 输入到FPGA中的8路并行数据，data_1~data_8（点顺序是data_1最先出来，依次排序，data_8是一个时钟并行数据最后点）, 同时寄存 比data_1之前一点数据 adc_data_first；寄存data_8之后晚一点数据adc_data_end；这样有助于data_1和data_8这两点边界检测；其中主要思想是抽取连续三点进行比较，检测三个点中中间位置数是否是峰值，如果是就对其保留输出，并记录此峰值位置（16位计数器，采集长度也是16位，这个是不固定可以更改）；温馨提示本例程是连续3点检测，读者也可以进行连续5点检测，检测有效会比3位更好；此例程较为简单，本例程只是参考，提供一种思路，有不足之处多多指教~

这是一篇硕士论文，其中的资料非常详细，所有的程序 论文均有。

基于CPLD等精度测频法的数字频率计设计，李剑勇，，本文利用 ALTERA 公司生产的CPLD可编程器件 EP1K50QC208-3，基于等精度测频法原理设计实现数字频率计。 硬件主要有主板及显示两大模块，软