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IIR滤波器的VHDL设计与仿真
采用一种基于FPGA的IIR数字滤波器的设计方案,首先分析了IIR数字滤波器的原理及设计方法,然后通过QuartusⅡ的设计平台,采用自顶向下的模块化设计思想将整个IIR数字滤波器分为:时序控制、延时、补码乘加和累加四个功能模块。分别对各模块采用VHDL进行描述后,进行了仿真和综合。
2022-04-30 17:22:47
3.46MB
EDA
IIR
FPGA
VHDL
1
自适应算术编码的FPGA实现
在简单介绍算术编码和自适应算术编码的基础上,介绍了利用FPGA器件并通过VHDL语言描述实现自适应算术编码的过程。整个编码系统在LTERA公司的MAX+plus Ⅱ软件上进行了编译仿真,测试结果表明:编码器各个模块的设计在速度和资源利用两方面均达到了较优的状态,可以满足实时编码的要求。
2022-04-29 12:27:50
104KB
算术编码
自适应
FPGA
VHDL
1
FPGA低功耗的设计技巧
FPGA低功耗的设计技巧,VHDL设计技巧,VHDL编程方法
2022-04-28 09:57:59
132KB
FPGA
VHDL
低功耗
1
基于FPGA的交织器的设计
这是基于FPGA的交织器的设计的完整的工程文件,软件:quartaus II 6.0,语言:VHDL;已调试通过,程序及仿真波形均正确。
2022-04-21 17:29:35
118KB
FPGA
VHDL
1
LDPC的FPGA程序
LDPC的VHDL和verilog代码,大家相互学习下!
2022-04-14 16:44:56
15KB
LDPC
FPGA
VHDL
Verilog
1
VHDL转Verilog工具.rar
硬件描述语言 是硬件设计人员和电子设计自动化 工具之间的界面 其主要目的是用来设计文件 建立电子系统行为级的仿真 模型 即利用计算机的巨大能力对用 或 建模的复杂数字逻辑进行仿真 然后再自动综合以生成符合要求且在电路结构上可以实现的数字逻辑网表 ??????? 根据 网表和某种工艺的器件自动生成具体电路 然后生成该工艺条件下这种具体电路的延时模
2022-04-12 22:34:19
19.93MB
FPGA
VHDL
Verilog
HDL
1
VHDL语言的数码管显示程序
用四个七段式数码管显示数据,实现动态显示,改变分频系数,可以实现不同的显示效果。
2022-04-11 21:01:10
3KB
FPGA
VHDL
显示
1
<>原书配套源码 包含i2c,uart,usb,vga等等模块
<>原书配套源码 包含i2c,uart,usb,vga等等模块
2022-03-25 20:08:52
1.48MB
FPGA
VHDL
Verilog
i2c
1
基于FPGA的交通灯代码
老师的交通灯程序,挺值得借鉴的。希望对大家有所帮助。用状态机编写的。
2022-03-13 15:36:55
5KB
FPGA
VHDL
1
VHDL的USB接口
VHDL的USB接口,来自Joris van Rantwijk,编写了完整的协议,只需要和符合UTMI接口的芯片外接构成USB。非常好,开源的,请注明GPL – GNU General Public License
2022-03-07 16:50:37
243KB
FPGA
VHDL
USB接口
UTMI
1
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