数字钟的分、时、秒模块编写，以及设置时钟功能，加闹钟功能

数字钟设计及Multisim电路图并完美运行

完整齐全目 录 1、绪论 1 2、VERILOG HDL的基础知识 2.1 VERILOG HDL 概述 2 2.1.1 VERILOG HDL的发展历史 2 2.1.2 VERILOG HDL的主要功能 2 3、多功能数字钟的设计 8 3.1设计任务 8 3.2 多功能数字钟功能概述 10 3.3多功能数字钟系统框图 10 3.4详细功能及状态描述 3 3.5 参考模块设计 10 3.5．1 主控制模块maincontrol 10 3.3.2. 时间及其设置模块timepiece_main 10 3.3.3. 时间显示动态位选模块TIME_DISP_SELSCT 12 3.3.4

89c51电子数字钟 源码和电路图 基于单片机89C51的lcd数字电子钟

（1）设计一个能自动计时的电子钟，利用数码管分别显示当前的小时，分钟， 秒。 （2）可以通过按键对当前小时、分钟进行调整设置。 （3）在调节当前时间的模式下，短按可实现加法，当长按调节分钟的按键两 秒以上时可实现快速连加（每秒四次加一）。 （4）具备闹钟功能，可通过按键设定闹钟时间，当当前时间到达闹钟设定时 间时，LED 按照预设花型闪烁，并播放闹铃音乐。 （5）具备整点报时功能，当当前时间为整点时，LED 组闪烁，并播放整点 报时音乐。 （6）具备秒表功能，启动秒表功能时，通过 switch 来开始秒表的计时。 （7）具备 LCD 显示功能，LCD 除开启菜单时显示菜单外，一直与数码管显 示同步变化，在显示闹钟设置时间、秒表计时等的同时显示当前功能名称。在显 示当前时间时，同步显示当前日期。 （8）具有日期设置功能，在 LCD 上显示当前时间时，同步显示日期。日期 可通过按键调节，有增加和减少两种调节方式，且对闰年的二月有特殊处理。

EDA技术在电子系统设计领域越来越普及，本设计主要利用VHDL语言在EDA平台上设计一个电子数字钟，它的计时周期为24小时，显示满刻度为23时59分59秒，另外还具有校时功能和闹钟功能。总的程序由几个各具不同功能的单元模块程序拼接而成，其中包括分频程序模块、时分秒计数和设置程序模块、比较器程序模块、三输入数据选择器程序模块、译码显示程序模块和拼接程序模块。并且使用QuartusII软件进行电路波形仿真，下载到EDA实验箱进行验证。该设计采用自顶向下、混合输入方式（原理图输入—顶层文件连接和VHDL语言输入—各模块程序设计）实现数字钟的设计、下载和调试。

本文利用Verilog HDL 语言自顶向下的设计方法设计多功能数字钟，突出了其作为硬件描述语言的良好的可读性、可移植性和易理解等优点，并通过Altera QuartusⅡ 4.1 和ModelSim SE 6.0 完成综合、仿真。此程序通过下载到FPGA 芯片后，可应用于实际的数字钟显示中。

基于Quartus II的数字钟设计 内含整个工程

EDA课程设计报告-- 数字钟（设计报告+仿真文件）

Verilog编写，多功能数字钟，具有基本显示，调时，电台报时和闹钟功能，分模块设计