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基于Verilog HDL设计的多功能数字钟
基于Verilog HDL设计的多功能数字钟
上传者:
zhlyz2003
|
上传时间: 2019-12-21 22:20:52
|
文件大小: 122KB
|
文件类型: pdf
基于Verilog
HDL设计的多功能数字钟
本文利用Verilog HDL 语言自顶向下的设计方法设计多功能数字钟,突出了其作为硬件描述语言的良好的可读性、可移植性和易理解等优点,并通过Altera QuartusⅡ 4.1 和ModelSim SE 6.0 完成综合、仿真。此程序通过下载到FPGA 芯片后,可应用于实际的数字钟显示中。
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评论信息
applegfbf :
讲解的很详细就是资料不是很准确
2013-05-14
lilong0522 :
可以使用,直接当作业都行
2013-02-27
yangxiujie126 :
讲解很详细,如获至宝!希望初学者都来关注!
2012-11-26
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