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Verilog实现
RS编码器
(255,247)
通过FPGA现场可编程逻辑器件,速度快,处理能力好,编写了
RS编码器
,带八个校验位,可以有效地进行纠错。
2022-06-12 22:23:09
4KB
RS编码
Verilog
FPGA
1
基于FPGA的
RS编码器
FPGA进行RS编码,其设计的关键是伽罗华域乘法器,内附WORD说明
2022-02-16 12:56:57
296KB
RS编码器
1
RS编码器
的Verilog HDL程序实现
RS(Reed-Solomon)码是差错控制领域中一类重要的线性分组码,由于其出众的纠错能力,被广泛地应用于各种差错控制系统中,以满足对数据传输通道可靠性的要求。
2021-12-28 21:41:19
785B
RS
编码器
Verilog
1
RS编解码VERILOG实现
RS 编码器,译码器,主要采用FPGA来实现软件使用verilog语言,从原理到硬件的实现,进行了功能仿真 以及板上调试,验证正确
2021-11-06 22:57:06
1.05MB
RS
编码器,译码
1
rs编码器
matlab程序
rs编码器
的matlab编码程序,输入为0-7的整数,代表GF域中的元素
2021-09-28 11:30:58
974B
matlab
rscode
1
基于FPGA的
RS编码器
的设计与实现
本文讲述的是基于FPGA的
RS编码器
的设计与实现。
2021-06-28 18:02:33
69KB
FPGA
RS编码器
verilog
乘法器
1
论文研究-RS(204,188)编码模块的设计与实现 .pdf
RS(204,188)编码模块的设计与实现,高松,陈钢,本文详细介绍了
RS编码器
的工作原理,介绍了有限域常数乘法器的实现方法;首先,通过编写M文件实现RS(204,188)编码器并在MATLAB中对其进�
2021-05-18 14:33:48
190KB
RS编码器
1
RS编解码VERILOG实现
RS 编码器,译码器,主要采用FPGA来实现软件使用verilog语言,从原理到硬件的实现,进行了功能仿真 以及板上调试,验证正确
2021-05-09 20:50:05
1.05MB
RS
编码器,译码
1
RS编解码VERILOG实现
RS 编码器,译码器,主要采用FPGA来实现软件使用verilog语言,从原理到硬件的实现,进行了功能仿真 以及板上调试,验证正确
2019-12-21 21:59:23
1.06MB
RS
编码器,译码器
1
RS编码器
sumilink仿真
教新手如何使用sumilink仿真
RS编码器
2019-12-21 21:19:00
841KB
RS编码器
1
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