RS编解码VERILOG实现

上传者: wylxh | 上传时间: 2019-12-21 21:59:23 | 文件大小: 1.06MB | 文件类型: rar
RS 编码器,译码器,主要采用FPGA来实现软件使用verilog语言,从原理到硬件的实现,进行了功能仿真 以及板上调试,验证正确

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评论信息

  • chidaofeng :
    只有编码。
    2013-07-30
  • 12312312312nnnn :
    没有编码啊
    2013-05-30
  • yuxuejun1123 :
    只有编码没有解码,,,,,
    2012-12-04
  • zhangshuangwu25 :
    这个很不错,有利于学习编码
    2012-07-29
  • Rorcy :
    只有编码没有解码啊
    2012-07-08

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