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RS编解码VERILOG实现
RS编解码VERILOG实现
上传者:
tld12
|
上传时间: 2021-05-09 20:50:05
|
文件大小: 1.05MB
|
文件类型: ZIP
RS
编码器,译码
RS 编码器,译码器,主要采用FPGA来实现软件使用verilog语言,从原理到硬件的实现,进行了功能仿真 以及板上调试,验证正确
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