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The DS90CR287 transmitter converts 28 bits of • 20 to 85 MHz Shift Clock Support LVCMOS/LVTTL data into four LVDS (Low Voltage • 50% Duty Cycle on Receiver Output Clock Differential Signaling) data streams. A phase-locked • 2.5 / 0 ns Set & Hold Times on TxINPUTs transmit clock is transmitted in parallel with the data streams over a fifth LVDS link. Every cycle of the • Low Power Consumption transmit clock 28 bits of input data are sampled and • ±1V Common-Mode Range (around +1.2V) transmitted. • Narrow Bus Reduces Cable Size and Cost The DS90CR288A receiver converts the four LVDS • Up to 2.38 Gbps Throughput data streams back into 28 bits of LVCMOS/LVTTL • Up to 297.5 Mbytes/sec Bandwidth data. At a transmit clock frequency of 85 MHz, 28 bits of TTL data are transmitted at a rate of 595 Mbps per • 345 mV (typ) Swing LVDS Devices for Low EMI LVDS data channel. Using a 85 MHz clock, the data • PLL Requires no External Components throughput is 2.38 Gbit/s (297.5 Mbytes/sec). • Rising Edge Data Strobe This chipset is an ideal means to solve EMI and • Compatible with TIA/EIA-644 LVDS Standard cable size problems associated with wide, high-speed • Low Profile 56-Lead TSSOP Package TTL interfaces.

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网上关于Ti文档的资料都比较乱，而且不全。自己在学习过程中把收集到的和自己下载的文档全部整理完成。下面列出部分文档的名称： 中断相关.docx C66x DSP CorePac 用户指南 C66x HyperLink 用户指南 C66x串行快速输入输出（SRIO）用户指南 C66x多核共享内存控制器 (MSMC) 用户指南 C66x通用输入输出 (GPIO) 用户指南 基于DSP6678实现多任务以太网络数据传输 CSL配置中断和HWI配置中断介绍_论坛 Ti官方视频Hwi资料中文版 DDR3 Memory Controller for KeyStone I Devices User's Gu

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基于AD630设计的锁定放大器，包含仿真文件和报告，可以参考，包含移相电路、比较器、滤波电路、乘法器等结构

手动机翻，寄存器介绍并不全面，HTML版打开会比较流畅一些。

蓝牙GATT协议描述文件，中文版，帮助你更好的理解蓝牙GATT协议，翻译自TI

TI给的FFT库，用于DSP281x系列，很好的FFT例程

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