搜索【vhdl，fpga】的结果

lcd12864_1.rar_VHDL/FPGA/Verilog_Others_源码

lcd12864的显示汉字程序源代码，共四行，每行8个汉字。

2021-08-12 17:08:20 1KB VHDL/FPGA/Verilog Others

VHDLqiangdaqi.rar_VHDL/FPGA/Verilog_VHDL_源码

VHDL四路抢答器该任务分成七个模块进行设计，分别为：抢答器鉴别模块、抢答器计时模块、抢答器记分模块、分频模块、译码模块、数选模块、报警模块，最后是撰写顶层文件。

2021-08-12 13:04:36 7KB VHDL/FPGA/Verilog VHDL

shift_register8.rar_VHDL/FPGA/Verilog_VHDL_源码

XilinxFPGA Verilog 8位的移位寄存器

2021-08-11 18:04:34 224KB VHDL/FPGA/Verilog VHDL

infrared_receive.rar_VHDL/FPGA/Verilog_VHDL_源码

红外接收处理，根据外部波形记录波形的高低电平时间，从而得到波形数据。

2021-08-11 18:04:18 638B VHDL/FPGA/Verilog VHDL

suoyou.rar_VHDL/FPGA/Verilog_matlab_源码

OFDM仿真的子程序，供大家参考！欢迎大家下载。

2021-08-11 18:04:16 1KB VHDL/FPGA/Verilog matlab

方案二.zip_VHDL/FPGA/Verilog_VHDL_源码

本系统是基于CPLD和单片机的一种用于信号频率周期、时间间隔和占空比测量的数字频率计，系统由AGC（自动增益控制）电路、宽带放大电路、高速比较电路实现有效值10mV/频率100MHz和处理显示部分组成，其中AGC电路实现幅度自动增益控制使放大后的信号幅度在一定的范围内保持一致，比较电路将前级电路输出的信号转换成CPLD

2021-08-10 10:36:42 77KB VHDL/FPGA/Verilog VHDL

can 控制器 vhdl语言编写

从opencore下载的vhdl编写的can总线控制器，可以编译，可以仿真。

2021-08-02 10:09:56 401KB can控制器 vhdl FPGA 逻辑

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基于FPGA数字频率计设计

本设计使用VHDL语言写的，并在QuartusII 12.0上进行了仿真实验，并在A-C5FB开发板上进行验证。

2021-07-30 20:50:16 801KB VHDL FPGA 频率计

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vhdl语言 100例详解

VHDL语言100例详解.pdf loop循环写一个串行读取数据

2021-07-30 12:39:42 6.81MB vhdl fpga开发

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基于IIC通信的EEPROM读/写Verilog/VHDL程序

基于IIC通信的EEPROM读/写实验程序：当按键1按下时，通过IIC总线执行AT24C02的数据写入操作；当按键2按下时，通过IIC总线执行AT24C02的数据读出操作；读写数据的地址一致，当执行读数据操作后，该数据将显示在数码管上。文件中包括Verilog和VHDL的两种语言的Quartus II程序，请您参考。

2021-07-09 13:19:11 201KB Verilog VHDL FPGA CPLD

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