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VHDLqiangdaqi.rar_VHDL/FPGA/Verilog_VHDL_源码
VHDLqiangdaqi.rar_VHDL/FPGA/Verilog_VHDL_源码
上传者:
pudn01
|
上传时间: 2021-08-12 13:04:36
|
文件大小: 7KB
|
文件类型: RAR
VHDL/FPGA/Verilog
VHDL
VHDL四路抢答器该任务分成七个模块进行设计,分别为:抢答器鉴别模块、抢答器计时模块、抢答器记分模块、分频模块、译码模块、数选模块、报警模块,最后是撰写顶层文件。
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