完整的算术逻辑单元(ALU)的 VHDL 代码! 包含其testbench代码!
2021-07-08 12:29:27 14KB 算术逻辑单元 ALU VHDL
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32位mips处理器的rtl级代码.可以实现各种指令功能
2021-07-07 09:06:25 4.7MB ALU
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含有REG_ALU的设计原码和比较规范的格式及内容,花了一下午做完的
2021-07-06 15:40:57 236KB hdu 寄存器堆设计 计算机组成原理
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基于Verilog设计单总线8位ALU,含详细注释,功能包括算术运算:带进位加减法、不带进位加减法 逻辑运算:与、或、异或、同或 移位操作:左移、右移、清零、取反 结合https://blog.csdn.net/qq_42334072/article/details/105922149食用更佳
2021-07-05 15:33:43 66KB Verilog FPGA ALU
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运算器设计,全部能用
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步骤都有,希望对你有帮助
2021-06-29 23:10:26 640KB 计组实验
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logsim华科慕课educoder头歌,运算器实现,除补码一位乘法器和原码一位乘法器通关,alu
2021-06-24 22:03:28 719KB logsim educoder alu
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Verilog HDL是一种硬件描述语言(HDL:Hardware Description Language),以文本形式来描述数字系统硬件的结构和行为的语言,用它可以表示逻辑电路图、逻辑表达式,还可以表示数字逻辑系统所完成的逻辑功能。 Verilog HDL和VHDL是世界上最流行的两种硬件描述语言,都是在20世纪80年代中期开发出来的。前者由Gateway Design Automation公司(该公司于1989年被Cadence公司收购)开发。两种HDL均为IEEE标准。
2021-06-22 16:26:49 1KB Verilog
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Verilog实现ALU的代码
2021-06-22 16:07:07 186KB Verilog实现ALU的代码
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