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计算机系统结构实验

计算机系统结构实验1到3，加法器流水线模拟，静态加法乘法流水线模拟，动态加法乘法流水线模拟，java编写

2019-12-21 21:18:52 27KB 流水线 java 计算机 系统结构

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流水线CPU Verilog设计

流水线CPU 包括转发暂停等功能，支持mips除eret ，mtc0，mfc0外所有指令(包括乘除运算，读写hi lo，取字节等等）乘除分别需要5，10个周期，代码能通过测试。

2019-12-21 21:01:42 2.15MB 流水线 CPU Verilog

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CPU设计（QuartusⅡ）

简单的CPU设计，采用QuartusⅡ软件实现。压缩包中有每个元件的设计，也有最终的CPU（压缩包中名为middle）

2019-12-21 20:59:51 1.76MB CPU，指令集，流水线，QuartusⅡ

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北航计算机组成Project5

北航计算机组成课Project5资源。包含：全套流水线cpu源代码，数据通路设计和暂停转发分析excel表，和覆盖所有冲突情况的Mips汇编强测代码。

2019-12-21 20:58:02 636KB 北航计组 Project5 流水线CPU 暂停转发

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三级流水线CPU

三级流水线CPU的实现成功在FPGA开发板上通过此CPU实现流水灯的运行。该CPU实现了十多条常用指令，代码中含有指令结构和详细介绍。通过DEBUG分析，最后得到的频率有200多M

2019-12-21 20:57:05 142KB verilo CPU

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五级流水线MIPS微处理器部分指令实现（Verilog）

Verilog实现MIPS处理器部分指令，不乏存在错误，还请指出。

2019-12-21 20:52:48 179KB MIPS

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vivado简单流水线cpu设计

计算机组成简单流水线cpu的设计 1.解决数据冒险和结构冒险 2.实现周期结束后各阶段的锁存 3.实现内部前推

2019-12-21 20:52:33 2.5MB cpu vivado verilog

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计算机组成原理实验（Modelsim+单周期+多周期流水线）

我们学校（某中部985高校）的计组实验资料大全，软件安装包+实验指导书+代码+实验报告。虽然我至今还是没有学会，但是共享一下资源帮助一下后来的同学吧！

2019-12-21 20:48:43 12.62MB 计组

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单功能非线性流水线的调度 java实现

使用java语言编写一个单功能非线性流水线的调度程序。输入为预约表，输出为最优调度方案。

2019-12-21 20:48:25 106KB 系统架构

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MIPS五级流水线的verilog实现

使用verilog实现MIPS经典的五级流水线，巧妙的解决结构冒险、数据冒险、控制冒险。

2019-12-21 20:31:43 6KB MIPS 流水线 verilog

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