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同步
FIFO
实现:顶层控制模块+
FIFO
控制模块+双端口RAM
同步
FIFO
实现;包含顶层控制模块+
FIFO
控制模块+双端口RAM
2021-08-09 09:02:45
4.41MB
FPGA
1
syn_
fifo
.rar
完整工程,含有设计文件和仿真文件,平台为Vivado,本人自己调试的,秋招面试常问的问题。
2021-08-08 19:07:49
11.47MB
秋招手撕fifo
1
RAM搭建的异步
FIFO
verilog代码
使用RAM搭建的异步
FIFO
verilog代码、与Xilinx IP放在一起仿真对比,对比结果一致
2021-08-07 09:10:57
300KB
FIFO
Verilog
RAM
1
OV7670(DCMI)摄像头.rar
处理器F407zgt6(有FSMC就可以,没有的话如F103Rb要自己写时序)OV7670无晶振无
FIFO
实现TFT屏摄像头
2021-08-03 09:46:08
8.54MB
摄像头
无FIFO
无晶振
STM32
1
基于FPGA的ARINC429通信协议设计实现
本文介绍了在FPGA上利用SoPC技术设计实现某机载数据传榆设备与机载专用计算机进行通信的ARINC429通信协议,实现了对ARINC429数据的一发一收。该系统模块充分利用了FPGA硬件可编程性、高度集成性、实时性的特点。测试表明,该系统具有速度快、可靠性高等优点。
2021-07-30 09:07:17
246KB
FPGA
SOPC
ARINC429
FIFO
1
FPGA串口数据包协议解析后的通过单口RAM和
FIFO
数据存储
关于FPGA在解析带有数据包协议的数据存储问题。FPGA先根据数据包协议接收数据并存储到RAM,在接收到完整一包数据后,将数据从RAM转移到
FIFO
中,后端的数据处理或者数据转发可以直接从
FIFO
读取。本代码模拟数据写入RAM,然后到
FIFO
过程。开发环境 Quartus18.1 ,开发语言 Verilog,仿真软件 Modelsim 6.6c
2021-07-28 11:06:04
6.33MB
FPGA
Verilog
串口数据存储
RAM
1
STM32S示波器 源码20.支持查看整个
FIFO
内的波形,仅对单次模式有效.zip
STM32S示波器 源码20.支持查看整个
FIFO
内的波形,仅对单次模式有效
2021-07-25 13:02:12
918KB
STM32S示波器
支持查看整个FIFO内的波形
1
lwrb开源库
FIFO
轻量级环形缓冲管理器开源库--可嵌入式移植
FIFO
轻量级环形缓冲管理器开源库--可嵌入式移植 blog: https://blog.csdn.net/Wekic/article/details/119046393
2021-07-24 10:01:32
1.11MB
FIFO
lwrb
1
async
fifo
.7z
异步
FIFO
设计(经典文档)
2021-07-23 14:03:07
200KB
AFIFO
FIFO
1
FIFO
深度计算
关于设计中
FIFO
应该选择多大的问题,一个很好的学习资料
2021-07-23 10:30:47
21KB
FIFO
深度
计算
1
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