FPGA串口数据包协议解析后的通过单口RAM和FIFO数据存储

上传者: changshengxiao | 上传时间: 2021-07-28 11:06:04 | 文件大小: 6.33MB | 文件类型: RAR
关于FPGA在解析带有数据包协议的数据存储问题。FPGA先根据数据包协议接收数据并存储到RAM,在接收到完整一包数据后,将数据从RAM转移到FIFO中,后端的数据处理或者数据转发可以直接从FIFO读取。本代码模拟数据写入RAM,然后到FIFO过程。开发环境 Quartus18.1 ,开发语言 Verilog,仿真软件 Modelsim 6.6c

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评论信息

  • coldsun1982 :
    这个不要下载了,没有串口部分,只有RAM到FIFO的,垃圾的一笔
    2021-09-18

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