一个带有miniSys指令集的CPU核与若干接口部件的SOC芯片,项目开发主要使用的是QUARTUS软件和verilog语言。
2019-12-21 20:07:02 5KB CPU verilog,quartus
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该程序实现了基本的数字钟的显示功能。并且也实现了基本的清零功能。其他的调时,报时功能只要在程序中添加简单代码即可实现。
2019-12-21 20:06:03 1.67MB 基于verilog的
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基于Verilog的cordic反正切FPGA例程,仅作学习使用。
2019-12-21 20:00:44 11.07MB atan fpga
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Verilog语言,Basys3平台,vivado编译,多功能电子钟。
2019-12-21 19:56:42 9KB Verilog basys 电子钟 vivado
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基于FPGA设计的verilog语言pwm,占空比可调的PWM,
2019-12-21 19:55:33 4KB PWM FPGA
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这是本人自己写的程序,加上注释,与大家分享,虽然平台是Xilinx,但是放在quartus 里面一样能用啊!你了解的!!!
2019-12-21 19:50:21 1.29MB 基于Verilog的VGA显示 汉字 字符 的例子
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基于Verilog+HDL的通信系统设计@,需要的下载,有参考价值
2019-12-21 19:43:26 19.26MB verilog
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基于verilog的数字频率计代码仿真和报告
2019-12-21 19:40:14 412KB 数字频率计
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FPGA 图像采集,采用verilog hdl硬件描述语言设计
2019-12-21 19:39:22 29KB FPGA 图像采集
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该代码是基于basys2的开发板,可以直接下载运行,其他开发板只需修改管脚即可使用。
2019-12-21 19:32:46 3.43MB FPG 交通
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