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基于fpga的
verilog语言
的一段式状态机的流水灯
一段式状态机的流水灯电路程序,可以实现流水灯功能
2021-03-01 22:05:50
3.1MB
fpga
led
verilog
quartus
1
Verilog语言
VGA显示 球球大作战
用按键控制球的移动方向,由于我这个板卡上只有四个按键,复位必须要用一个,所以只可以控制左右下 三个方向。
2021-02-25 03:33:41
1.02MB
FPGA
VERILOG
VGA
1
ZYNQ7035 pl端有限状态机
verilog语言
源码.zip
在
Verilog语言
中经常用到有限状态机,处理相对复杂的逻辑,设定好不同的状态,根据触发条件跳转到对应的状态,在不同的状态下进行相应的处理。在程序中设计8位寄存器,① Idle状态下,判断shift_start是否为高,若高,则进入Start状态;②在Start状态延迟100个周期,进入Run状态,进行移位处理;第一种Melay状态机采用一段式写法,一个always语句中包括状态转移,状态转换台条件判断,数据输出; 第二种Moore状态机采用三段式写法,状态转移用一个always语句,判断状态转移的条件是组合逻辑,采用一个always语句,数据输出也是单独的always语句,直观清晰;
2021-02-21 14:05:16
1KB
verilog
ZYNQ7035
有限状态机
1
spi 通信的master部分使用的
verilog语言
实现.zip
可以做为你的设计参考 module spi_master(rstb,clk,mlb,start,tdat,cdiv,din, ss,sck,dout,done,rdata); input rstb,clk,mlb,start; input [7:0] tdat; //transmit data input [1:0] cdiv; //clock divider input din; output reg ss; output reg sck; output reg dout;
2021-02-05 17:06:05
1KB
spi通信的master
spi_master
verilog语言
FPGASPI逻辑
1
Verilog语言
编写32位桶形移位器(含仿真代码).pdf
数字逻辑基础与Verilog设计
2021-01-31 14:02:51
407KB
verilog
桶型移位器
1
基于verilog 语言的数字电子钟设计
基于verilog 语言的数字电子钟设计,数码管实时显示时、分、秒的数字时钟(24小时显示模式);可以调节小时,分钟;能够进行24小时和12小时的显示切换;可以设置任意时刻闹钟,并且有开关闹钟功能;有整点报时功能,几点钟LED灯闪亮几下。
2021-01-06 10:33:16
3.88MB
verilog
电子钟
1
Verilog语言
参考手册
Verilog语言
参考手册包括中文PDF版本和英文CHM帮助文档版本,很好的参考资料
2020-11-24 15:40:28
318KB
Verilog
中文PDF
英文CHM
1
farrow滤波器的
verilog语言
设计实现
farrow滤波器的
verilog语言
设计实现,大家可以参考一下
2020-01-20 03:05:17
1KB
farrow滤波器
verilog
1
基于
verilog语言
的实例
基于verilog的几十个实例,适合初学者入门,同时也可以做为开发者使用相关模块或语法时查找的资料。
2020-01-14 03:01:03
4.86MB
FPGA
verilog实例
1
基于
verilog语言
的数字时钟设计
有计时,跑表,闹钟,调整时间四大功能,功能完善,消逗也不错,
2020-01-04 03:14:53
1009KB
verilog
数字时钟
1
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