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emf-gef-ve.7z
emf-gef-ve.7z
2021-01-28 00:34:32
31.81MB
chenzhenguo
1
基于Verilog二分频的testbench源码
使用Verilog语言编写的二分频testbench的源代码,可以直接加入仿真软件中进行仿真测试。
2020-05-05 22:36:45
12KB
Verilog
testbench
1
verilog HDL 16位乘法器实现及testbench文件
适合新手学习verilog HDL语言。并附有testbench文件,共新手学习使用。
2020-04-01 03:03:11
1KB
testbench+verilog
HDL
16位乘法器
1
ROM verilog代码
ROM Verilog源代码,通过验证,含有".tb"文件以供测试使用
2020-02-03 03:14:07
29KB
ROM
Verilog
源代码
testbench
1
异步清零、技术使能、数据加载等不同使能的4位计数器的Verilog源程序以及对应的testbench测试程序和仿真波形
异步清零、技术使能、数据加载等不同使能的4位计数器的Verilog源程序以及对应的testbench测试程序和仿真波形,已经测试过了,已经测试过了,欢迎下载,收取大家2个财富值,希望大家多多包涵,自己的csdn账号也没有财富值了。
2020-01-03 11:22:28
336KB
Verilog
4位计数器
testbench
1
CORDIC算法Verilog实现,带testbench
用Verilog实现CORDIC,功能比Xilinx提供的更完善。全并行结构,可计算sin和cos函数
2019-12-28 17:42:38
1.36MB
CORDIC
Verilog
1
串口通信的Verilog代码及TestBench
这是个串口通信的Verilog代码,代码简单明了。在顶层收到PC一个字节然后再发给PC。适合初学者使用
2019-12-21 22:19:17
4.13MB
串口
Verilog
TestBench
1
经典8位RISC-CPU设计(附testbench)
采用哈佛结构设计的简单8位RISC-CPU,包含testbench,可直接在modelsim中出波形。是《Verilog HDL程序设计实例详解》中的8位RISC-CPU的源码,亲测可用!
2019-12-21 22:16:35
435KB
8位
RISC
CPU
testbench
1
简易异步FIFO代码及testbench
简易异步FIFO代码及testbench,满足基本FIFO要求,简单实用
2019-12-21 22:15:24
917B
简易异步FIFO代码及testbench
1
教你如何写verilog语言的测试文件testbench
最讨厌下载要积分的人。此文档想要就免费拿去看看。挺有用的学习资料
2019-12-21 22:11:12
5.69MB
testbench
,
verilog
1
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