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[{"title":"（ 3 个子文件 3KB ） CPLD 配置 xilinx fpga 的verilog 源代码（只有注册用户可下载）","children":[{"title":"EPROM_RD.V <span style='color:#111;'> 2.11KB </span>","children":null,"spread":false},{"title":"CPLD.V <span style='color:#111;'> 1.71KB </span>","children":null,"spread":false},{"title":"FPGA_CFG.V <span style='color:#111;'> 7.32KB </span>","children":null,"spread":false}],"spread":true}]
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