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4位全加器和4位计数器的testbench仿真程序+实例程序包自取
4位全加器和4位计数器的testbench仿真程序+实例程序包自取
2022-12-21 22:52:24
3KB
verilog
1
使用 D 触发器的 7 位计数器:使用 D 触发器的 7 位计数器设计-matlab开发
使用 D 触发器的 7 位计数器设计
2022-11-13 22:13:40
17KB
matlab
1
cnt_24gzxszh_24位计数器_vivado的cnt_
FPGA 在vivado平台上利用veilog语言实现24位计数功能
2022-11-04 09:51:47
65KB
24位计数器
vivado的cnt
1
FPGA与数字系统设计:实验四 32位计数器.doc
FPGA与数字系统设计:实验四 32位计数器.doc
2022-06-08 22:06:05
1.49MB
fpga开发
文档资料
verilog十进制计数器,带进位,仿真无误
本人亲自仿真无误的verilog十进制计数器,程序有中文说明容易读懂,可直接用MOdelsim打开。十进制带进位加计数器
2022-05-02 14:41:51
452B
verilog十进制带进位计数器,仿真无误,用modelsim仿真无误
1
99位计数器单片机控制
用单片机控制的秒表计数器、由89C51控制、、两个数码管显示
2021-12-13 11:04:27
29KB
99
1
异步复位十位计数器verilog HDL语言程序以及仿真下载
异步复位十位计数器verilog HDL语言程序以及仿真下载
2021-12-11 16:14:52
165KB
异步复位
十位计数器
verilog
HDL
1
基于VHDL的四位计数器
本程序是基于VHDL的四位计数器,适用刚刚接触数字系统设计群体
2021-11-10 19:37:21
494B
VHDL
计数器
1
Quartus ii与verilog实现8位计数器,Modelsim仿真工程
Quartus ii 13.0 与 Verilog实现8位计数器,Modelsim仿真,有testbench。
2021-11-05 23:16:09
2.95MB
Quartus
ii
Verilog
计数器
1
51单片机做的一个两位计数器
用at89c51做的一个两位加减计数器 有proteus仿真图 源程序代码 以及hex文件 源程序用c语言写的
2021-10-31 23:34:47
17KB
单片机
计数器
1
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