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DDR SDRAM
VHDL
编写
DDR SDRAM 参考设计
VHDL
写的,源文件,仿真文件,模型文件,说明文档都有
2021-11-14 20:02:03
998KB
DDR
SDRAM
设计
VHDL
1
步进电机的
VHDL
设计方案
自己做的简单的步进电机的
VHDL
的设计方案!
2021-11-14 19:08:10
56KB
步进电机
1
hdb3编码
vhdl
程序设计
该程序实现了hdb3的编码功能,经调试后,符合编码要求。主要有插v插b和极性转换三部分组成。
2021-11-14 16:25:19
3KB
hdb3
vhdl
1
基于
VHDL
的任意奇偶分频
用
VHDL
写的任意数奇偶分频,下载到实验板上用过,完全好使
2021-11-14 14:38:04
885B
VHDL
任意
分频
奇偶
1
基于
VHDL
的计数器设计
用
VHDL
写的计数器的程序,已经测试可以运行。。希望对大家有好处
2021-11-14 13:11:08
425KB
VHDL
计数器
1
基于
VHDL
的旋转编码器接口电路的实现
用
VHDL
语言设计的增量式旋转编码器接口电路,实现了四倍频、双向计数的功能以及与单片机的接口。给出了在MAX Plus II环境下的
VHDL
源代码和时序仿真结果。本设计在角度测量、位移测量和高度测量等方面有广泛的应用价值。
2021-11-14 09:29:45
322KB
旋转编码器
1
uart 串口接收模块
vhdl
(已通过板级验证)
uart 串口接收模块, 通过串口助手调试验证,包含本实验所需的
vhdl
代码以及仿真文件,所用实验开发板:AC620
2021-11-13 20:15:02
4.15MB
vhdl
uart
1
uart 发送模块
vhdl
(已通过板级验证)
UART串口发送模块,通过串口助手调试验证,包含实验所需的
vhdl
代码以及仿真文件,实验开发板AC620
2021-11-13 20:10:00
4.08MB
uart
vhdl
1
VHDL
华为内部编程规范
VHDL
华为内部编程规范,好的编程规范可以避免很多低级错误,提高编译成功率!
2021-11-12 22:46:48
560KB
VHDL编程规范
1
DodgeBall:Terasic DE10 Lite的DodgeBall游戏(主要为
VHDL
)-源码
DodgeBall:Terasic DE10 Lite的DodgeBall游戏(主要为
VHDL
)
2021-11-12 19:00:03
8.42MB
game
fpga
stupid
dodgeball
1
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