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基于Verilog的数字频率计的代码

Vorilog语言编写的数字频率计测频部分的代码，本人毕业设计测频部分实用代码，绝对有效。系统的时钟频率为100M，包含50M的自检信号。

2019-12-21 21:13:54 6.86MB 数字频率计

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基于Verilog HDL数字频率计的设计与实现

基于Verilog HDL数字频率计的设计与实现，工程

2019-12-21 21:10:05 4.16MB VerilogHDL 数字频率计 占空比 quartus

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MSP430G2553测频率12864显示完整程序

一个比较完整的msp430G2553的频率计，用12864显示，程序比较完善，实用性较强，参考价值很大

2019-12-21 21:09:36 78KB msp430 12864 频率计

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基于FPGA的高精度频率计设计

使用ＱｕａｒｔｅｒＩＩ软件进行ｖｅｒｉｌｏｇ语言编写的代码，里面有完整的代码以及器件的链接

2019-12-21 21:07:49 6.78MB ＦＰＧＡ 频率计

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用STM32频率计

简易的用STM32设计的频率计，有放大电路，电压比较器电路，和计数器电路，分频电路

2019-12-21 21:06:40 2.63MB 相移

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基于Multisim数字频率计的设计与仿真

希望对各位有用，写得很细，基于Multisim数字频率计的设计与仿真，某人的课程设计

2019-12-21 21:04:29 4.62MB 强烈推荐

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此文档系笔者参加2015年全国电子设计竞赛的F题—数字频率计所撰写的作品报告，实物作品先后获得了北京市一等奖和全国二等奖，里面的方案可以参考，但是仍旧需要在此基础上进行调试，同时配合相应的ARM和FPGA软件代码，从而实现良好的频率计功能。

2019-12-21 21:03:48 124KB 2015全国电设 F题国二

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简易频率计的设计（完整论文）

简易频率计的设计论文，完整论文，包含电路图，结构图，各模块设计细节

2019-12-21 21:02:53 125KB 频率计

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VHDL频率计的设计

VHDL 频率计，可以最小频率是1HZ，最大由FPGA的芯片限制。可以准确测量方波频率。

2019-12-21 20:59:58 355KB VHDL 频率计

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eda课程设计数字频率计的设计

EDA课程设计，数字频率计的设计。用VHDL语言

2019-12-21 20:59:51 125KB EDA

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