RISC_V 多周期CPU设计,里面包含基于最新提出的RISC_V指令集设计的多周期CPU,使用Verilog语言,代码注释详细,提供官方给出的测试样例,RV32I 基本整数指令四十多条指令都有实现,波形仿真通过。
2019-12-25 11:52:33 60KB RISC_V 多周期CPU Verilog
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《开放指令集与开源芯片发展报告》(已创建书签)中国开放指令生态(RISC-V)联盟 2019 年 1 月发布,主要内容包括:1 前言;2 开放指令集与开源芯片的兴起;3 RISC-V 开放指令集生态现状;4 MIPS 开放生态现状;5 开源芯片发展现状;6 业界动态;7 各国战略计划与项目部署;8 挑战、机遇与未来发展方向;9 总结。
2019-12-21 22:24:02 1.59MB RISC-V
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RISC-V峰鸟E200源码
2019-12-21 22:17:49 76.08MB 蜂鸟E200
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采用哈佛结构设计的简单8位RISC-CPU,包含testbench,可直接在modelsim中出波形。是《Verilog HDL程序设计实例详解》中的8位RISC-CPU的源码,亲测可用!
2019-12-21 22:16:35 435KB 8位 RISC CPU testbench
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清华大学电子系微机原理课程设计题目。4人合作完成。 包含CPU的VHDL、Verilog源代码、仿真文件、波形结果、系统框图、实验报告、以及一个简易汇编器的源代码和可执行文件。 Quartus仿真实现了32位RISC微处理器,支持数据处理(包括乘除法),数据传送,子程序调用,中断及跳转。时序仿真主频可达70MHz。 采用Tomasulo算法处理指令流水中的数据相关,并提出了一种对Tomasulo就够的改进。设计了Cache结构提高访存效率。
2019-12-21 22:06:27 3.43MB 微机原理 CPU 硬件描述语言 Tomasulo
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riscv 指令集协议翻译
2019-12-21 22:00:20 3.65MB risc-v
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《自己动手写CPU》/使用Verilog语言设计CPU/pdf+光盘 语言的介绍 环境的搭建 设计步骤与过程
2019-12-21 21:38:14 172.09MB CPU设计 RISC
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使用的vivado2017.04版本创建的工程,完成蜂鸟E203 处理器内核的移植,搭建SOC片上系统。运行在A7的FPGA板卡上。
2019-12-21 21:35:07 23.84MB 分享
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一个简单的用verilog语言描述的RISC_CPU的例子,这个例子结构简单,对于初学者很有用
2019-12-21 21:32:21 678KB verilog RISC CPU
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Computer Organization and Design RISC-V Edition 一书所有的PPT/Slides 演示文档全章节打包下载。如没找到对应的书,可以在看过之前的版本上,对照这些PPT更新下。
2019-12-21 21:26:40 10.68MB P&H CPU
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