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RISC-V & NVDLA简单入门介绍

开源的处理器指令集平台和开源的深度学习加速器平台，两者结合可以提供更多种的可能。文档给第一次接触这两个项目的人，提供入门级的参考。

2019-12-21 20:01:53 1.43MB 深度学习

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RISC-V中文架构手册

RISC-V中文架构手册 RISC-V-Reader-Chinese-v2p1 RISC-V中文架构手册

2019-12-21 20:00:07 7.88MB RISC-V RISC-V RISCV中

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精简指令集的8位CPU的verilog源代码

verilog设计的精简指令集8位CPU源代码，里面有验证平台，以及后端DC的综合报告，门级网表，以及覆盖率报告。

2019-12-21 19:57:44 191KB RISC CPU 8位 verilog

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RISC-V 二值化 CNN 芯片加速器进行人员检测

Adding a Binarized CNN Accelerator to RISC-V for Person Detection

2019-12-21 19:55:48 10.43MB risc-v cnn 加速器 detect

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使用Verilog 写 RISC CPU 资料和代码

使用Verilog 写 RISC CPU 资料和代码，内容广，是CPU设计的备之作

2019-12-21 19:32:13 861KB RISC CPU Verilog

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solution manual for Computer Organization and Design RISC-V Edition

solution manual for Computer Organization and Design RISC-V Edition 课后习题答案

2019-12-21 19:31:13 16.9MB risc-v solution man

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RISC-V的FPGA设计与实现资料

本文件手把手教你设计 CPU——RISC-V 处理器，有完整的Verilog代码与详细的技术手册，基于蜂鸟E200设计与实现，分享出来，供大家一起学习

2019-12-21 19:22:41 30.08MB RISC-V

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基于Vivado的精简指令CPU设计

利用Xilinx的Vivado套件（包括VivadoHLS）设计的精简指令集CPU架构，里面包含了各个模块所需的仿真文件。下载资源的人需要先了解一下ARM指令集与ARM架构。

2019-12-21 18:58:51 978KB Vivado CPU RISC HDL

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