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《Verilog
HDL
数字控制系统设计实例》-冼进-源代码
《Verilog
HDL
数字控制系统设计实例》-冼进-源代码
2021-11-29 12:49:00
11.78MB
Verilog
实例
1
Verilog
HDL
的任意的分频器设计
这是一个基于verilog语言的分频器的设计的代码,在设置的位宽范围以内任意系数的分频器均可以采用本代码。当然,讲寄存器的位宽设置更高,可以继续增加分频系数
2021-11-29 11:27:58
1KB
分频器
1
四位全加器的modelisim实现.docx
基于modelsim编写了一个四位二进制全加器的实现代码,适合初学者,附有仿真结果,程序作者编写,测试通过。
2021-11-28 19:32:28
356KB
verilog
HDL
modelsim
数字IC
1
用Verilog
HDL
编写的汉明码校验
用Verilog
HDL
编写的汉明码校验、 此只是一个试验
2021-11-28 15:59:30
171KB
汉明码
校验
1
开源项目——多功能数字时钟 verilog
hdl
本实例用verilog
hdl
编写,能实现日前的显示,时钟的显示,跑表,功能强大,通过FPGA开发板测试并能正常工作。 文件包括全部工程文件。
2021-11-27 21:02:18
110KB
多功能数字时钟
1
可逆计数器(内含文档及Verilog
HDL
设计代码)
可逆计数器是一种双向计数器,可以进行递增计数,也可以进行递减计数,根据计数控制信号的不同,在时钟脉冲的作用下,计数器可以进行加1或减1的操作。 下面描述的是一个位宽为4的可逆计数器,即该计数器在不同控制信号下可以分别实现加法计数和减法计数的功能。
2021-11-26 14:22:35
105KB
计数器
1
XILINX FPGA数字信号处理权威指南 从
HDL
到模型和C的描述.pdf
XILINX FPGA数字信号处理权威指南 从
HDL
到模型和C的描述pdf高清版本
2021-11-25 16:55:46
84.58MB
fpga
xilinx
数字信号处理
C语言
1
verilog
hdl
一个按键控制一个LED亮
verilog
hdl
一个按键控制一个LED亮
2021-11-25 14:21:57
211B
按键控制LED
1
x-
hdl
: verilog v
hdl
代码转换
按照说明安装即可 轻松破解 方便易用 vista测试可用 没有win7所以没测试过win7下安装可否 有安装过的 请给大家分享下经验
2021-11-25 13:11:13
19.29MB
vhdl
verilog
互转
转换
1
fpga3month1weekfirstproject_led.rar
基于AX516开发板按键控制led灯的实验
2021-11-25 11:01:17
101KB
fpga
key
led
hdl
1
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