搜索【verilog_hdl】的结果

verilog HDL编写的LDPC编码程序

用verilog编写的LDPC编码源程序

2021-05-15 17:29:40 9KB verilogHDL LDPC

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数字示波器——cycloneII芯片、VerilogHDL语言编写

开发板上芯片是cycloneII，利用Verilog HDL语言编写程序，将波形和波形数据显示在2.4寸TFT液晶屏上。在开发板上成功实现。

2021-05-15 15:37:06 1.5MB 数字示波器 fpga VerilogHDL

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可编程逻辑器件 Verilog HDL 跑马灯电路实验

此文件是可编程逻辑器件设置跑马灯程序实验报告，内容详实，有具体的步骤和程序源代码，并经过精心排版，希望对学习Verilog HDL的朋友提供帮助

2021-05-14 15:03:00 351KB Xilinx ISE 跑马灯程序 VerilogHDL

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FPGA与PC上的串口调试助手通信（verilogHDL）

利用串口调试助手是实现pc机和fpga的串口通信功能，程序附注释。

2021-05-13 16:04:57 100KB fpga uart 串口通信

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FPGA浮点数加减乘除基于verilogHDL

FPGA浮点数加减乘除基于verilogHDL,非常适合基础学习，大学生实验作业

2021-05-12 17:02:11 17KB VerilogHDL FPGA 浮点数 加减乘除

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基于verilogHDL的AES加密解密程序

2021-05-12 17:02:11 469KB VerilogHDL FPGA AES 加密解密

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verilogHDL 实现交通灯控制代码

本代码采用verilogHDL开发，实现的十字路口交通灯控制系统。

2021-05-10 19:02:20 245KB 交通灯 verilog

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《Verilog HDL设计与实战》配套代码

《Verilog HDL设计与实战》配套代码,每章节目录代码。

2021-05-06 21:32:31 107.5MB VerilogHDL

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91-Vivado XADC IP核设计.7z

Vivado XADC IP核设计，Vivado仿真工程。

2021-04-30 09:04:46 134KB FPGA VerilogHDL XADCIP核 Vivado

92-Vivado DDR3 IP核设计.7z

Vivado DDR3 IP核设计，Vivado仿真工程。

2021-04-30 09:04:45 5.98MB FPGA VerilogHDL Vivado DDR3IP核