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verilog
单周期
CPU设计
支持指令集为:{addu, subu, ori, lw, sw, beq, lui, jal, jr,nop,sll,j,lh,sh}。 处理器为
单周期
设计。
2021-06-10 13:11:17
7KB
verilogCPU
1
24条指令MIPS
单周期
CPU源文件等资源.zip
24条指令MIPS
单周期
CPU课设设计有这个压缩包足够
2021-06-08 22:02:50
5.87MB
课设
24条指令
CPU设计
MIPS单周期
单周期
CPU完整代码
完整的
单周期
CPU QUARTUS代码,能够直接运行
2021-06-08 11:32:27
1.92MB
CPU
1
基于MIPS32的
单周期
CPU的设计与实现.zip
基于vivado软件,使用verilog语言,较好地实现MIPS32的20条指令。包含测试代码和CPU实现代码。 实现的具体功能如下: 1.设计的CPU能够执行20条整数指令,每条指令的编码长度均为32位; 2.指令类型有:计算类型、访问存储器类型、条件转移类型和无条件转移类型等; 3.实现CPU的封装处理。 具体设计思路参见:https://blog.csdn.net/qq_45288566/article/details/103656372
2021-06-05 20:43:23
9.76MB
单周期CPU
vivado
verilog
1
单周期
CPU Vivado
用Vivado实现一个
单周期
CPU,不包含烧电路板内容,根据2018年的计算机组成原理及接口技术的实验课程要求。
2021-06-05 20:08:55
146KB
单周期CPU
Vivado
1
基于verilog的MIPS32
单周期
CPU设计与实现.zip
基于vivado软件,使用verilog语言,较好地实现MIPS32的20条指令。包含测试代码和CPU实现代码。 实现的具体功能如下: 1.设计的CPU能够执行20条整数指令,每条指令的编码长度均为32位; 2.指令类型有:计算类型、访问存储器类型、条件转移类型和无条件转移类型等; 3.实现CPU的封装处理。 具体设计思路参见:https://blog.csdn.net/qq_45288566/article/details/103656372
2021-06-01 08:47:31
10.75MB
verilog
vavido
MIPS32
1
单周期
处理器(systemverilog实现,vivado开发)
单周期
处理器(CPU),支持以下指令:lw、sw、beq、addi、add、sub、and、or、slt。使用的开发环境是vivado,文件在压缩包中的single_cycle_processor.xpr内。压缩包内有
单周期
CPU的示意图。
2021-05-31 10:10:08
504KB
systemverilog
cpu
单周期处理器
1
single_cycle_cpu,
单周期
cpu
单周期
CPU,single_cycle_cpu,南京大学计算机系计算机组成原理实验-Single-cycle CPU, single_cycle_cpu, Nanjing University Computer Science Department of Computer Composition Principle Experiment
2021-05-31 09:55:34
1.72MB
单周期cpu
single_cycle_cpu
1
一个模拟
单周期
cpu的mips编译器
这是一个利用类模拟cpu各部分工作的MIPS编译器,附实验报告
2021-05-30 16:24:11
13.45MB
c++
MIPS
1
《计算机组成原理》实验报告-
单周期
CPU设计全过程
单周期
CPU设计全过程: 组成原理实验课,包含十六条指令实现,完整的代码以及详细的实验报告,是本人实验课的作业。用verilog HDL语言或者VHDL语言来编写,实现
单周期
CPU的设计。 用Verilog HDL语言编写MIPS32
单周期
CPU程序 (1)理解MIPS常用的指令系统并掌握
单周期
CPU的工作原理与逻辑功能实现。 (2)通过对
单周期
CPU的运行状况进行观察和分析,进一步加深理解。
2021-05-29 16:52:38
2.37MB
单周期CPU设计
计算机组成原理
MIPS32
Verilog
1
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