AGM CPLD family provides low-cost instant-on, non-volatile CPLDs, with densities from 256, 272 to 576 logic LUTs and non-volatile flash storage of 256Kbits. The devices offer up to 144 I/O pins featuring with a user flash memory (UFM), and in-system programming. The devices are designed to reduce cost and power while providing programmable solutions for a wide range of applications.
2022-04-06 01:11:08 311KB cpld AG256SL100 EPM240T100 EPM570T100
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AG1280Q32 AG1280Q48 替换: EPM1270 XC2C32 XC2C64 XC2C128 XC2C256 XC2C512 XC9536 XC9572 XC95144 XC95216 XC95288 LCMXO2-256 LCMXO2-640 LCMXO2-1200 A3P030 A3P060 A3P125 A3P250 Altera:EPM1270 Xilinx:XC2C32 XC2C64 XC2C128 XC2C256 XC2C512 XC9536 XC9572 XC95144 XC95216 XC95288 Lattice:LCMXO2-256 LCMXO2-640 LCMXO2-1200 MicroSemi:A3P030 A3P060 A3P125 A3P250
2022-04-06 01:11:07 455KB cpld AG1280Q48 AG1280Q32 EPM1270
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对于初学CPLD来说,通俗易懂,把复杂的流程讲解得十分透彻,并且一步步操作,是一个很不错的资料,
2022-03-21 10:31:03 3.49MB CPLD(good)
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分析了SGPIO总线的数据传输机制,用CPLD模拟SGPIO总线协议来实现并行数据的串行传输,并将其与串并数据转换集成芯片进行对比,说明了前者的应用优势,并且指出了其应用场合。采用Lattice Diamond IDE进行了Verilog HDL代码编写和综合,并用ModelSim进行时序仿真,最终下载到CPLD器件进行测试。
2022-03-16 14:42:59 232KB SGPIO总线 CPLD 串并数据转换 板级通信
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该例程实现了在CPLD上的串口收发功能,对于实用以及学习都有很好的指导作用
2022-03-14 19:08:02 1.36MB CPLD 串口 UART
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ALTERA FPGA_CPLD设计基础篇与高级篇俩本合集,从基础到高级
2022-03-13 10:32:19 66.5MB ALTERA FPGA
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本文讲述如何用逻辑语言来实现SPI master接口,代码风格比较规范,给初学者参考
2022-03-09 10:54:52 484KB Verilog SPI接口 FPGA/CPLD
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ispLEVER5.0简明中文教程(CPLD篇).pdf
2022-03-06 21:50:54 2.77MB ispLEVER CPLD
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基于CPLD和单片机的多功能信号发生器
2022-03-04 15:05:10 2.51MB CPLD 单片机 信号发生器
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EPM240 CPLD 核心板 原理图 已经过PCB设计并验证,保证可用
2022-02-28 11:06:28 41KB EPM240 CPLD 核心板 开发板
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