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ST-BUS
总线接口模块的Verilog HDL设计
ST-BUS
是广泛应用于E1通信设备内部的一种模块间通信总线。结合某专用通信系统E1接口转换板的设计,本文对
ST-BUS
总线进行了介绍,讨论了
ST-BUS
总线接口收发模块的设计方法,给出了Verilog HDL实现和模块的时序仿真图。
2022-03-10 14:16:47
162KB
ST-BUS
Verilog
HDL
接口模块
1
基于CPLD的
ST-BUS
总线收发模块设计与实现
文中主要讨论外部接口与
ST-BUS
总线通信所需公共模块(即
ST-BUS
收发模块)的设计与验证。
2021-11-16 14:30:11
97KB
CPLD
ST-BU
总线
收发模块
1
st-bus
-标准
st-bus
-标准
st-bus
-标准
st-bus
-标准
st-bus
-标准
st-bus
-标准
st-bus
-标准
2021-07-20 21:35:56
221KB
st-bus-标准
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