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多码率、多码长LDPC译码器的设计与实现
针对IEEE
802.16e标准
,基于层译码算法(TDMP)提出了一种适用于多码率、多码长的LDPC码译码器结构。该译码器采用半并行化和流水线设计,可以在保证电路灵活性的同时提高译码吞吐量。利用Xilinx公司的ISE工具进行综合仿真,使用的FPGA芯片为Virtex4-xc4vfx12-sf363-12,最大工作频率为170.278 MHz,译码吞吐量可达到128.77 Mb/s。
2022-03-20 16:58:30
253KB
IEEE
802.16e标准
TDMP
LDPC码译码器
1
IEEE
802.16e标准
中LDPC编码的实现与仿真
根据IEEE
802.16e标准
中LDPC编码的定义,提出了一种利用高速状态机来实现编码的快速算法。在Quartus II下使用Verilog HDL实现了该算法并进行了时序仿真。仿真结果表明,设计具有良好的实时性,克服了以往设计中预处理复杂、消耗逻辑资源多的缺点。最后利用MATLAB对该设计与DVB-S2缩短码的BER性能进行了比较,分析了制约DVB-S2缩短码性能的因素。
2021-11-02 15:41:42
446KB
LDPC编码
1
802.16e标准
(英文全文)
这是802.16e 的全引文内容,不错的资料,对于研究下一代无线通信很有帮助
2019-12-21 22:09:35
12.25MB
802.16e
1
802.16e协议
附有802.16e-2009协议协议解读和原版标准
2019-12-21 19:52:59
10.35MB
802.16e标准
1
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