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FPGA控制AD7606读取模数转换的数据采用Verilog语言编写代码，并仿真测试

The AD7606/AD7606-6/AD7606-4 是分别具有八个、六个和四个通道的16位、同步采样、模数数据采集系统（DAS）。每个器件均包含模拟输入钳位保护、二阶抗混叠模拟滤波器、采样保持放大器、16 位电荷再分配逐次逼近模数转换器 (ADC)、灵活的数字滤波器、2.5 V 基准电压源和基准缓冲区以及高速串行和并行接口。采用SPI通信

2023-03-13 09:05:30 3KB AD7606 FPGA verilog

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基于 FPGA 的 I2C 总线模拟，采用 Verilog HDL 语言编写

基于FPGA的I2C总线模拟，采用Verilog HDL语言编写 (FPGA-based I2C bus simulation, using Verilog HDL.)

2023-01-03 17:44:58 241KB FPGA Verilog I2C

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M序列生成程序采用verilog语言

采用verilog语言生成m序列用用一位寄存器原理

2022-05-26 16:28:46 232B M序列 verilog

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采用Verilog HDL语言实现阵列乘法器和Booth编码乘法器

采用Verilog HDL语言实现阵列乘法器和Booth编码乘法器、电子技术,开发板制作交流

2022-04-20 16:25:03 164KB 采用Verilog HDL语言实现阵列乘法器和Booth编码乘法器 VerilogHDL 乘法器 混合压缩器 开发板 电子技术 ARM开发板

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AES算法采用verilog硬件实现

verilog实现AES加密和解密算法，可以移植到任何FPGA平台上面，具有良好的通用性，并且有C语言和Python的验证程序，非常的好！

2021-05-07 00:38:06 50.61MB AES verilog

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采用Verilog编写的SPI_core

这是一个采用Verilog编写的SPI核，能够实现16位数据的传输，传输数据的宽度用户可以修改，同时我也为该核编写了测试文件，使用非常方便。该IP核代码，经过简单修改就能够使用，非常适合想了解和学习SPI总线的朋友。

2019-12-21 21:14:53 4KB FPGA Verilog SPI源码

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基于ISE14.7中的RAM模块IP核，采用Verilog，全面了解RAM工作原理

1,实现双口RAM，完全掌握调用IP核的流程; 2,深入了解RAM，模拟1450字节数据，然后写入RAM，完成测试； 3,完成RAM读写测试，数据“顺序”输出。

2019-12-21 20:33:51 7.74MB FPGA RAM Verilog

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