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histogram equalization verilog implementation
直方图均衡的Verilog实现 从Matlab读出图像为image.txt文件,经过Modelsim读入TXT文件进行直方图均衡处理,将输出结果再读出为image_he.txt文件,然后在Matlab观察直方图均衡增强效果,由于Matlab中直方图统计概率近似小数所以计算出为近似值,而FPGA中应用移位代替除法所以计算出为准确值,实验表明,硬件实现和Matlab软件直方图均衡处理达到了共同的效果!
2022-04-30 10:51:29
2KB
直方图均衡,Verilog,Modelsim,Matlab,
1
增量式pid.rar
项目需要最近在做pid控制器,看了一些文章,写了一个增量式pid算法。适合新手学习原理。代码注释很多。
2022-04-30 10:39:05
14.74MB
pid
verilog
1
dw8051.tar.gz
基于DW8051 IP的仿真环境搭建。内部集成了IO的模型,完全实现了一个标准8051芯片的功能仿真。
2022-04-29 22:12:58
2.82MB
dw8051
MCU
verilog
1
FPGA/cpld Verilog语言DDS
MCU控制FPGA/cpld产生步进为1Hz的正弦波,FPFA晶振频率为50M,最多产生10M
2022-04-29 21:30:29
9KB
MCU控制FPGA/cpld产生步进为1Hz的正弦波
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基于FPGA的h.264压缩实现
基于FPGA的h.264压缩实现
2022-04-29 17:45:47
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h264
verilog
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Fpga取整运算和IP核触发运算资源消耗和时序约束
本人自己实验结果。关于Fpga取整运算和IP核除法运算资源消耗时间消耗,和时序约束分析。都是实验结果的截图,比较乱,比较乱!
2022-04-29 02:07:18
151KB
Fpga
verilog
Ip核
时序约束
1
verilog七段数码管
verilog 写的七段数码管的显示 老师布置的作业,写了好几天!刚开始学verilog
2022-04-28 22:00:26
611B
verilog
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YUV 转 RGB的Verilog代码
此代码是YUV转RGB的Verilog源代码,经测试代码可用,请放心下载
2022-04-28 10:44:30
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YUV
RGB
Verilog
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MC8051单片机 VHDL实现源代码
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2022-04-28 02:51:38
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8051
VHDL
Verilog
逻辑
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NCO:方便使用的数控振荡器(NCO)Verilog RTL
Verilog RTL中的(NCO) 可配置的混合实现: 复数输出{Im,Re} 整数(2的补码)实现 Pi / 4查台台 N2-CORDIC阶段 N3-动态旋转CORDIC位移台 参数 WD:数据宽度(每个组件) SCALE:输出信号的定点幅度 WA0:相位累加器宽度 WA1:查询表位 WA2:CORDIC阶段的位 WA3:动态旋转CORDIC的位
2022-04-27 19:06:59
15KB
JavaScript
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