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FPGA综合系统设计(四):串口控制的DDS信号发生器
设计一个系统:串口接收频率、相位控制字,控制的DAC输出波形(正弦波、三角波、锯齿波、方波、直流)设计中取DAC输出时钟为50MHz,波形存储深度为512点(取信号的一个周期),用matlab生成mif格式的文件分别存储正弦波、方波、三角波、锯齿波的数据。含testbench,已在开发板上验证。
2019-12-21 19:45:28
491KB
FPGA
DDS
uart
Quartus
1
FPGA综合系统设计(一)1.250μs冲击电压测量与显示
ADC采集信号,FIFO缓存,通过串口发送数据到PC显示,Q
uart
us工程;具体说明可参考本人博客。CSDN博客搜索:FPGADesigner
2019-12-21 19:45:28
4.31MB
FPGA
ADC
UART
1
MATLAB串口采集数据(进阶)
MATLAB串口采集数据(进阶)+实时显示数据曲线+以当前计算机时间为名字保存数据为txt的.M文件压缩包
2019-12-21 19:43:52
3KB
MATLAB
UART
PLOT
1
Android USB转串口编程
Android通过USB转串口跟串口设备进行通信。
2019-12-21 19:42:36
2.92MB
Android
USB
UART
1
msp430f5529的
uart
程序
msp430f5529的
uart
程序,里面包含多种发送方式和接收方式,初学者用
2019-12-21 19:42:01
13KB
5529
uart
1
Zedboard的USB转串口驱动
Zedboard上的USB转串口驱动程序,当然也可以自己上官网下
2019-12-21 19:41:47
1.3MB
Zedboard
USB
Uart
1
基于16倍过采样的FPGA串口解析
基于16倍过采样的串口解析代码,有说明文档,发送说明文档,接收说明文档,和串口协议分析。发送和接收文档有对工程代码的逐句注释解释。
2019-12-21 19:37:44
1.77MB
fpga
verilog
uart
1
PSoc4串口收(中断)发例子
在PSoc4平台上运用串口(
UART
)的例子,串口波特率设置为115200,使用中断接收的模式,将接收到的数据在中断函数快速返回发送方。
2019-12-21 19:33:32
960KB
PSoc4
UART
串口
中断接收
1
基于verilog的带fifo的串口设计
使用verilog开发的带fifo的串口,波特率115200,8,n,1,已在fpga上验证通过。
2019-12-21 19:31:24
17.03MB
verilog
uart
usart
fpga
1
stm32F103zet6开串口通信2 C语言
本代码(工程文件,可直接编译、烧写)基于stm32F103ZET6,开通串口2(
uart
2,使用正点原子的精英板V3,PA2/PA3两个串口均可正常工作,PA2/PA3在板子上没有集成串口调试硬件,在进行电脑调试时请使用PA9/PA10的进行验证或另配硬件)。正常情况下网络上例程均只有一个串口被打开(即
uart
1),使用者在移植时只需要把
uart
2头文件与源文件add进自己的文件夹即可。
2019-12-21 19:30:44
3.4MB
uart
stm32
战舰V3
串口2
1
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