实测亲测xilinx fpga uart 串口rs232例子实例工程,不出错发送接收数据测试,节省资源3根线串口,可以学习ip core用法verilog写

上传者: mynameislinduan | 上传时间: 2019-12-21 20:21:43 | 文件大小: 503KB | 文件类型: rar
实测亲测xilinx fpga uart 串口rs232例子实例工程,ISE打包工程,不出错发送接收数据测试,无状态机,节省资源3根线串口,可以学习rs232串口和倍频ip core用法,字节编写,用verilog编写 基于一个xilinx的学习板子,具体io配置请看工程,测试内容内容是 pc 用 uart rs232发一个字节到fpga,fpga收到之后马上把字节加1发回给pc,uart的波特率是50m时钟,用到了ise的pll倍频,可以学习pll用法,uart 的 verilog 代码没有用到状态机,只用到txd,rxd,gnd这3根最基本的串口通讯线,极大的简化了fpga资源。整个工程打包,方便大家下载到之后可以马上用,相信对初学xilinx fpga 或者 ip cone用法的初学者来说,学习很用帮助。

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评论信息

  • AHAO_TJU :
    其实写的还可以
    2019-10-26
  • 凡人就行 :
    学习学习,谢谢分享
    2019-06-17
  • zhaohaixv :
    谢谢,学习学习,
    2018-06-27
  • baidu_38219313 :
    不太行啊没有ise文件
    2018-05-06
  • 知足者长乐 :
    还不错,我已经完成连续收发!
    2016-09-12

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