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千兆以太网通讯、数据采集、存储显示等_PCB源文件-AD软件.rar
FPGA四层板设计,已经手工焊接验证和编程验证:包含千兆以太网(RTL8211);SD卡存储;AD7606并行8路采集;RTC等;串口通讯。欢迎交流讨论
2021-02-06 14:03:52
33.63MB
FPGA硬件设计
RTC+Uart硬件设计
SD卡硬件设计
AD7606硬件设计
调测
UART
串口Verilog HDL 通信fpga逻辑工程源码+自定义协议说明.zip
调测
UART
串口Verilog Q
uart
us 10.1逻辑工程源码+自定义协议说明,已在项目中使用,可以做为你的设计参考。
UART
下位机与上位机通信协议: 1、通信采用异步串口通信,波特率为115.2KBPS; 2、上位机发送数据格式:55--F1--DATA1-- DATA2--FF 例如:55 F1 02 11 FF 3、下位机返回上位机的数据格为 AA—AA –F2—DATA1-- DATA2 例如:AA AA F2 02 11 4、DATA1数据为测试设备的位置信息
2021-02-05 22:05:00
2.53MB
调测UART串口
串口VerilogHDL
pga逻辑工程源码
自定义uart协议
UART
串口Verilog通信cpld q
uart
us10.1逻辑工程源码+自定义
uart
协议说明.zip
UART
串口Verilog通信cpld q
uart
us10.1逻辑工程源码+自定义
uart
协议说明,已在项目中使用,可以做为你的设计参考。 下位机与上位机通信协议: 1、通信采用异步串口通信,波特率为115.2KBPS, 2、上位机发送数据格式:55--F1--DATA1-- DATA2--FF DATA1 GPIO 输出高低控制; DATA2 GPIO 32路GPIO选择控制; 下位机
uart
CPLD接收数据【控制32路GPIO输】 55 F1 01 (00-1F) FF 32路GPIO中的一路输出高 55 F1 08
2021-02-05 22:05:00
592KB
UART串口Verilog
quartus10.1逻辑工程源
Verilog通信cpld
FPGA串口VERILOG
Uart
_14M_1.zip
STM32, 串口波特率14MBit/s测试工程, 参考我的博客 STM32串口 14MBit/s波特率测试 https://blog.csdn.net/weifengdq/article/details/113695910
2021-02-05 17:06:10
769KB
UART
STM32
14M
STLINK-V3
1
Verilog实现
uart
串口逻辑特率可选9600、19200、38400、115200 8位数据1位校验1位停止.zip
Verilog实现
uart
串口协议,波特率可选9600、19200、38400、115200。8位数据为,1位校验位,1位停止位。核心代码包括
UART
,TX,RX,Baud,FIFO , 以及
uart
_tb测试激励文件,可以做为你的设计参考。
2021-02-05 17:06:06
6KB
Verilog实现uart串口
VerilogUART源码
波特率9600
8位数据为,1位校验位,1位停止
UART
_232.zip
UART
_232 串口VERILOG 代码,包括
UART
_baudrate
UART
_rx
UART
_tx 三个逻辑模块Q
UART
US 18.0工程源码
2021-02-05 13:04:46
3.15MB
UART串口VERILOG代码
串口FPGA逻辑
QUARTUS串口工程源码
RS232串口
EPM240 CPLD
UART
串口通信verilog Q
uart
us ii 工程源码.zip
EPM240 CPLD
UART
串口通信 verilog Q
uart
us ii 工程源码, 逻辑芯片为EPM240T100C5, q
uart
us ii 10.1逻辑源码工程文件, verilog上电蜂鸣器响一声,3个LED灯闪烁,然后串口数据收发,串口波特率11520,1起始位8数据位1停止位,数据通信协议:发送55 F1 01 (DATA) FF 32路GPIO中的一路输出高,接收数据返回: AA AA BB CC DD 完整的q
uart
us ii 10.1工程文件,可以做为你的设计参考。
2021-02-04 18:11:37
588KB
UART串口通信verilog
Quartusii工程源码
FPGA串口逻辑
VERILOGRS232
添加16550
UART
IP内核的遇到问题.docx
zynq的AXI
uart
16550 配置
2021-02-04 18:09:34
1.43MB
AXIuart16550
1
pg142-axi-
uart
lite.pdf
Xilinx官方
UART
的IP文档
2021-02-03 23:47:33
572KB
fpga
uart
1
PL2303 USB转
UART
串口板 AD设计硬件原理图+PCB+BOM+软件驱动.zip
PL2303 USB转
UART
串口板 AD设计硬件原理图+PCB+BOM+软件驱动,采用2层板设计,板子大小为29x14mm,双面布局布线,Altium Designer 设计的工程文件,包括完整的原理图PCB文件,可以用Altium(AD)软件打开或修改,可作为你产品设计的参考。
2021-02-03 23:47:08
7.8MB
PL2303
USB转UART串口板
硬件原理图+PCB+BOM+软件
原理图PCB
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