Verilog实现uart串口逻辑特率可选9600、19200、38400、115200 8位数据1位校验1位停止.zip
Verilog实现uart串口协议，波特率可选9600、19200、38400、115200。8位数据为，1位校验位，1位停止位。核心代码包括UART ,TX，RX，Baud，FIFO ， 以及uart_tb测试激励文件，可以做为你的设计参考。
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[{"title":"（ 6 个子文件 6KB ） Verilog实现uart串口逻辑特率可选9600、19200、38400、115200 8位数据1位校验1位停止.zip","children":[{"title":"uart20201225","children":[{"title":"uart.v <span style='color:#111;'> 1.68KB </span>","children":null,"spread":false},{"title":"fifo.v <span style='color:#111;'> 1.49KB </span>","children":null,"spread":false},{"title":"Baud.v <span style='color:#111;'> 810B </span>","children":null,"spread":false},{"title":"uart_tb.v <span style='color:#111;'> 9.49KB </span>","children":null,"spread":false},{"title":"RX.v <span style='color:#111;'> 3.06KB </span>","children":null,"spread":false},{"title":"TX.v <span style='color:#111;'> 2.77KB </span>","children":null,"spread":false}],"spread":true}],"spread":true}]
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xuexiangmvp :用户下载后在一定时间内未进行评价，系统默认好评。2021-07-27 -
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