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Verilog实现uart串口
逻辑特率可选9600、19200、38400、115200 8位数据1位校验1位停止.zip
Verilog实现uart串口
协议,波特率可选9600、19200、38400、115200。8位数据为,1位校验位,1位停止位。核心代码包括UART ,TX,RX,Baud,FIFO , 以及uart_tb测试激励文件,可以做为你的设计参考。
2021-02-05 17:06:06
6KB
Verilog实现uart串口
VerilogUART源码
波特率9600
8位数据为,1位校验位,1位停止
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