vivado ECO的使用方法
2023-03-08 11:09:11 1.47MB vivado ECO 增量编译
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基于VGG Simple手写体数字识别的研究与FPGA实现 vivado的工程 大家自行学习
2023-03-07 10:16:46 35.47MB FPGA vivado 手写体数字识别
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详细的介绍了基于FLASH的烧写过程
2023-03-01 21:41:55 1.82MB FLASH烧写
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异步fifo乒乓操作工程文件
2023-02-22 19:46:52 17.82MB fpga verilog 乒乓操作
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本文档详细讲述了Vivado工程的建立,以及常用的技巧,感谢作者无私分享
2023-02-21 11:35:57 5.01MB Vivado 教程
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PYNQ Classification - Python on Zynq FPGA for Neural Networks
2023-02-09 15:00:22 4.79MB python FPGA PYNQ VIVADO
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FPGA的AM调制解调源码,其中FIR滤波器根据MATLAB设计。 【AM_jietiao】文件是基于zynq-7000系列,但没有涉及AD与DA,只是单纯的仿真。 【AM包络检调制解调_Vivado源码】文件基于Artix-7系列,从AD读入信号后,进行AM调制,并解调DA输出。
2023-02-02 20:00:47 94.71MB fpga AM调制解调 包络检波 zynq
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基于XC7A35T,Vivado工程文件
2023-02-02 10:25:56 9.87MB TDC
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设计定制的AXI从属外设 使用Xilinx Vivado工具创建自定义AXI-lite从属外围设备的指南 这是一份针对希望在Xilinx嵌入式处理器系统中设计自己的AXI4-lite从属外设的用户的应用笔记。 该版本的应用笔记是使用为。 此信息同样适用于使用AXI4互连的其他Xilinx板和体系结构。 提供的示例代码是为编写的。 会费 提供了代码示例供您使用,但是请随时通过拉请求以通常的方式将自己的代码贡献回该存储库。 请从此存储库中派生,然后在您的派生中创建一个适当命名的分支,然后再提交回此存储库。 请不要从您的“主”分支提交拉取请求。 代码的每个新添加项都应属于其自己的已提交分支。 谢谢。
2023-01-29 04:42:45 1.09MB VHDL
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The Zynq Book is all about the Xilinx Zynq®-7000 All Programmable System on Chip (SoC) from Xilinx. http://www.zynqbook.com/,英文原版。
2023-01-26 15:07:04 19.4MB Zynq SoC FPGA Vivado
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