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11【Verilog实战】交通信号灯RTL&TB.zip,博文【Verilog实战】栏目,项目11的完整RTL和TB
11【Verilog实战】交通信号灯RTL&TB.zip,博文【Verilog实战】栏目,项目11的完整RTL和TB
2022-06-14 18:56:39
6KB
verilog
交通信号灯
1
基于verilog的单周期cou设计
本项目主要利用Verilog语言设计一一个基于MIPS架构的CPU。分别设计指令存储器、寄存器堆、ALU、取指令部件、数据存储器、立即数处理单元、主单元控制器、ALU控制单元。内含仿真,可直接仿真验证。
2022-06-14 11:10:25
3.73MB
FPG
CP
1
同步fifo.zip
FIFO的Verilog源代码,可以任意调整深度的,不错,已经验证过 异步fifo下次发 源代码
2022-06-14 00:07:21
2KB
FIFO
Verilog
源代码
调整深度
1
串并转换Verilog HDL
串并转换Verilog HDL FPGA,为了你能认真读代码,测试程序请自己编写,改代码经过调试正确
2022-06-13 20:50:12
2KB
串并转换Verilog
HDL
FPGA
1
12均匀分布随机数的Verilog HDL语言程序设计.doc
12均匀分布随机数的Verilog HDL语言程序设计
2022-06-13 18:05:30
15KB
文档资料
Verilog HDL模型的不同抽象级别.ppt
Verilog HDL模型的不同抽象级别.ppt
2022-06-13 09:05:09
3.57MB
Verilog
Verilog数字设计基础.ppt
Verilog数字设计基础.ppt
2022-06-13 09:05:08
3.66MB
Verilog
SPI的verilog实现
SPI的verilog实现 有详细的注释 全面且容易理解 好东西 分享一下
2022-06-13 01:48:27
8KB
SPI
verilog
1
SPI-verilog
spi 控制器与 modelsim仿真文件、波形
2022-06-13 01:33:06
42KB
已经验证
1
Verilog实现RS编码器(255,247)
通过FPGA现场可编程逻辑器件,速度快,处理能力好,编写了RS编码器,带八个校验位,可以有效地进行纠错。
2022-06-12 22:23:09
4KB
RS编码
Verilog
FPGA
1
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