RISC_CPU是一个复杂的数字逻辑电路，但是它的基本部件的逻辑并不复杂。从第四章我们知道可把它 分成八个基本部件： 1)时钟发生器 2)指令寄存器 3)累加器 4)RISC CPU算术逻辑运算单元 5)数据控制器 6)状态控制器 7)程序计数器 8)地址多路器 各部件的相互连接关系见图8.2。其中时钟发生器利用外来时钟信号进行分频生成一系列时钟信号， 送往其他部件用作时钟信号。各部件之间的相互操作关系则由状态控制器来控制。各部件的具体结构 和逻辑关系在下面的小节里逐一进行介绍。 8.2.1时钟发生器 时钟发生器 clkgen 利用外来时钟信号clk 来生成一系列时钟信号clk1、fetch、alu_clk 送往CPU 的其他部件。其中fetch是外来时钟 clk 的八分频信号。利用fetch的上升沿来触发CPU控制器开始 执行一条指令，同时fetch信号还将控制地址多路器输出指令地址和数据地址。clk1信号用作指令寄 存器、累加器、状态控制器的时钟信号。alu_clk 则用于触发算术逻辑运算单元。 时钟发生器clkgen的波形见下图8.2.2所示： CLK CLK1 CLKGEN ALU_CLK FETCH CLK CLK1 ALU_CLK FETCH 图1. 时钟发生器 RESET RESET

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1999年版FIDIC《简明合同格式》（简称：绿皮书），英文版。 《简明合同格式》（绿皮书）：这是一本全新的合同条件，“推荐用于资本金额较小的建筑或工程项目。根据项目的类型和具体情况，这种格式也可用于较大资本金额的合同，特别是适用于简单或重复性的工程或工期较短的工程。这种合同的通常情况是，由承包商按照雇主或其代表（如有时）提供的设计进行工程施工，但这种格式也可适用于包括或全部是，由承包商设计的土木、机械、电气和（或）建筑物的合同”－－摘自FIDIC原文序。 Short Form of Contract, which is recommended for building or engineering works of relatively small capital value. Depending on the type of work and the circumstances, this form may also be suitable for contracts of greater value, particularly for relatively simple or repetitive work or work of short duration. Under the usual arrangements for this a design provided by the Employer or by his representative (if any), but this form may also be suitable for a contract which includes, or wholly comprises, Contractor-designed civil, mechanical, electrical and/or construction works. Windows WinHelp 4.0 制作，具有方便灵活的目录、索引、跳转链接查阅，可以快速找到想要查阅的条款。每个条款的引用，均设置了链接，可以不断跟踪条款引用。

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