重庆大学 大三下计算机组成原理第二个项目,满分通过的 十六位单周期CPU设计,用的软件是logisim-win-2.7.1,包含project2终极.circ RAM.hex ROM.hex ROM.s 设计报告.doc 可直接提交了
2021-06-24 17:52:53 6.28MB 16位 单周期CPU logisim
1
计算机组成原理大作业,VHDL 编写,FPGA测试实现15条指令
2021-06-22 19:15:26 150B CPU VHDL
1
MIPS CPU设计实验,可以将三级时序,硬布线,微程序,中断等相关概念全部融合在一起,不需要大家画数据通路,只需要专注控制器的设计,适合组成原理课程开展CPU单元实验。
2021-06-15 19:45:54 1008KB MIPS单周期CPU-组成原理实
1
单周期CPU设计verilog,课程设计
2021-06-13 14:12:08 3.2MB 单周期CPU verilog
1
这是计算机组成原理课设,基于verilog实现的单周期CPU代码,实现了add, addu, addi, addiu, sub, slt, and, or, xor, beq, j, sw, lw, lui,andi,addu,ori,xori,共18条指令,能够运行简单的冒泡排序。内含单周期图。
2021-06-12 09:04:00 503KB verilog vivado 单周期CPU
支持指令集为:{addu, subu, ori, lw, sw, beq, lui, jal, jr,nop,sll,j,lh,sh}。 处理器为单周期设计。
2021-06-10 13:11:17 7KB verilogCPU
1
24条指令MIPS单周期CPU课设设计有这个压缩包足够
2021-06-08 22:02:50 5.87MB 课设 24条指令 CPU设计 MIPS单周期
完整的单周期CPU QUARTUS代码,能够直接运行
2021-06-08 11:32:27 1.92MB CPU
1
基于vivado软件,使用verilog语言,较好地实现MIPS32的20条指令。包含测试代码和CPU实现代码。 实现的具体功能如下: 1.设计的CPU能够执行20条整数指令,每条指令的编码长度均为32位; 2.指令类型有:计算类型、访问存储器类型、条件转移类型和无条件转移类型等; 3.实现CPU的封装处理。 具体设计思路参见:https://blog.csdn.net/qq_45288566/article/details/103656372
2021-06-05 20:43:23 9.76MB 单周期CPU vivado verilog
1
用Vivado实现一个单周期CPU,不包含烧电路板内容,根据2018年的计算机组成原理及接口技术的实验课程要求。
2021-06-05 20:08:55 146KB 单周期CPU Vivado
1