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[{"title":"（ 6 个子文件 6.28MB ） 16位单时钟周期CPU设计","children":[{"title":"ROM.s <span style='color:#111;'> 138B </span>","children":null,"spread":false},{"title":"project2终极.circ <span style='color:#111;'> 67.40KB </span>","children":null,"spread":false},{"title":"logisim-win-2.7.1.exe <span style='color:#111;'> 6.64MB </span>","children":null,"spread":false},{"title":"设计报告.doc <span style='color:#111;'> 1.44MB </span>","children":null,"spread":false},{"title":"ROM.hex <span style='color:#111;'> 54B </span>","children":null,"spread":false},{"title":"RAM.hex <span style='color:#111;'> 25B </span>","children":null,"spread":false}],"spread":true}]
评论信息
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lhy1102 :不知道 converter.circ 哪里有啊2021-04-10 -
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qq_42184465 :很棒的设计2018-12-21
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qq_27605279 :有错误，部分部件不能使用2015-11-12
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lxkdsh :在结构设计上给了很大的帮助，谢谢啦2015-10-09
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qq_25746279 :可惜不是Verilog的2015-05-19
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