搜索【Verilog程序】的结果

DE2-70开发板程序实例

这是DE2-70开发板上的7个典型程序实例，主要基于verilog 语言编写

2021-06-30 10:49:23 21.6MB verilog程序、nios ii、DE2-70、fpga

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fpga操作tlv5616 DA样的verilog程序

2021-06-28 12:14:24 2KB fpga操作tlv5616 DA样的verilog程序

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FPGA实现DDS信号源（单频、线性调频）的verilog程序（可电脑端实时控制）

pc2ad_0329_tested.rar

2021-06-17 09:05:26 5.95MB 程序 verilog DDS FPGA

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FPGA 实现 DDS 正弦波、方波、三角波发生器 Verilog 程序（已验证）Quartus工程文件

FPGA 实现 DDS 正弦波、方波、三角波发生器 Verilog 程序（已验证）Quartus工程文件。鉴于上次传的只有Verilog代码，怕对于像半年前的我一样的初学者仍然会遇到很大困难，现特把本人课程设计的整个Quartus工程文件一并上传，希望有用。用时只需用Quartus打开工程文件即可编译运行，频率可达16M没问题 FPGA DDS 信号发生器 Quartus工程文件 Verilog

2021-06-09 21:08:31 15.98MB FPGA DDS 信号发生器 Quartu

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ps2的verilog程序

关于ps2的verilog程序，给大家使用

2021-05-23 09:53:49 272KB ps2程序

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verilog基本实验程序

37个verilog基本程序，包括数码管、流水灯、译码器、时钟等等

2021-05-22 10:25:53 456KB verilog、程序

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FPGA+AD7606并行8通道采集源Verilog程序

这人本人一个项目中的源程序，采用AD7606不间断8路不间断采集外部电压，送到FPGA之后，再由FPGA经过Cypress芯片与PC机通信。 FPGA+AD7606并行8通道采集源Verilog程序，FPGA+AD7606并行8通道采集源Verilog程序，FPGA+AD7606并行8通道采集源Verilog程序，FPGA+AD7606并行8通道采集源Verilog程序，FPGA+AD7606并行8通道采集源Verilog程序，FPGA+AD7606并行8通道采集源Verilog程序

2021-05-20 10:00:24 687KB FPGA Altera AD7606 Verilog

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hash的sha1的verilog程序

sha1算法的verilog程序。请需要的同学下载。

2021-05-18 15:46:02 11KB sha1 verilog

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最完整的altera实现DDS正弦波、方波、三角波发生器Verilog程序用QuartusII工程

最完整的altera实现DDS正弦波、方波、三角波发生器Verilog程序用QuartusII工程，本资源是全网最全面的，分为代码和文本二部分。并在友晶科技板子上验证过。

2021-05-18 07:59:47 15.87MB 波发生器 altera 正弦波 方波

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王金明：《Verilog HDL 程序设计教程》

王金明编写的《Verilog HDL 程序设计教程》 PDF版本的非常清晰

2021-05-12 18:27:09 111KB Verilog HDL Verilog 程序

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