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基于FPGA的高精度数字
频率计
的设计
基于FPGA的高精度数字
频率计
的设计,非常适合毕设,论文。有用。
2020-01-03 11:20:25
3.69MB
FPGA
高精度
数字
频率计
1
CPLD FPGA 课程设计报告(附源代码)
大学期间的课程设计报告,
频率计
,附源代码.
2020-01-03 11:16:39
168KB
频率计
FPGA
CPLD
1
等精度
频率计
的RTL实现verilog代码
采用等精度的数字
频率计
课程设计,verilog代码,通过仿真和FPGA验证
2019-12-28 17:20:10
4KB
频率计
Verilog
1
简易数字
频率计
设计——时基电路
了解数字
频率计
测频率与测周期的基本原理;熟练掌握数字
频率计
的设计与调试方法及减小测量误差的方法。
2019-12-24 03:06:32
349KB
放大控制,时基电路
1
pic单片机实现的
频率计
在上次传的基础上作了改进,可将信号的周期和高电平时间通过led显示出来(us),用1000000除以显示的周期时间即可得频率值(Hz),测量范围为50Hz-10kHz,误差仅有两三个指令周期(us)
2019-12-21 22:26:40
19KB
pic16f877
proteus
汇编源码
CCP模块捕捉功能的应用
1
VHDL实现的数字
频率计
VHDL实现的数字
频率计
,带QUARTUS工程文件,仿真通过,另外可以测试脉宽和占空比
2019-12-21 22:25:53
328KB
VHDL
数字频率计
1
quartus2 基于原理图方式构建
频率计
quartus2 基于原理图方式构建
频率计
2019-12-21 22:22:42
37KB
fpga
1
15电赛国一数字
频率计
单片机部分-STM32
这个是 15国赛 国一
频率计
32407vet6的 mcu控制部分
2019-12-21 22:20:44
5.64MB
国赛
频率计stm32
部分
1
51外部中断
频率计
51单片机
频率计
,本
频率计
是基于51单片机的外部中断和定时器设计的,测频范围为2-500KHz,压缩包内包含数码管显示和串口显示两个程序,以适应不同的用户需求,本程序已通过测试,请放心下载!
2019-12-21 22:18:26
82KB
51单片机
频率计
外部中断
定时器
1
基于FPGA的
频率计
的设计
详细介绍了基于FPGA的
频率计
的设计,使用等精度测量原理,精度大小可调!目录附源码……
2019-12-21 22:16:13
1.07MB
FPGA
频率计
1
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