l、能进行正常的时、分、秒计时功能，分别由6个数码显示24小时、60分钟的计数器显示。
2、能利用实验系统上的按钮实现“校时”、“校分”功能；
（1）按下“SA”键时，计时器迅速递增，并按24小时循环；
（2）按下“SB”键时，计时器迅速递增，并按59分钟循环，并向“时”进位；
（3）按下“SC”键时，秒清零；抖动的，必须对其消抖处理。
3、能利用扬声器做整点报时：
（1）当计时到达59’50”时开始报时，频率可为500Hz；
计满23小时后回零；计满59分钟后回零。
（2）到达59’59”时为最后一声整点报时，整点报时的频率可定为lKHz。
4定时闹钟功能
2021-09-10 21:02:28
3.72MB
1
基于FPGA的简单CPU实现，基于FPGA的简单CPU实现，基于FPGA的简单CPU实现，基于FPGA的简单CPU实现
2021-08-17 14:03:33
80KB
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TestBench生成器
首次更新 2021.8.14
根据同一路径下的Verilog/System Verilog文件生成相对应的TestBench；
自定义时钟频率；
适应不同编辑器；
限制：
只能生成单个文件的TestBench，且要在同一目录下；
时钟信号必须包含“clock”或“clk”，大小写不限；
复位信号必须包含“reset”或“rst”，大小写不限；
后缀为“_n”的复位信号会被识别为低电平有效，否则默认高电平有效；
目前只支持端口声明在端口列表里的设计文件。
2021-08-15 01:52:41
2.32MB
1
1.基于FPGA的cordic算法程序，输出IQ信号的幅度及相位
2.精度较高，相位精度为2/9000，幅度精度为1/1000。其中相伴扩大了100倍，幅度扩大了1.6倍。
2021-07-09 15:33:45
3KB
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基于verilogHDL的PCIE接口设计以及Modelsim仿真,FPGA（Field Programmable Gate Array）是在PAL、GAL等可编程器件的基础上进一步发展的产物.PCI-Express是一种高速串行计算机扩展总线标准，它原来的名称为“3GIO”，是由英特尔在2001年提出的，旨在替代旧的PCI，PCI-X和AGP总线标准。
2021-07-09 14:03:07
1.78MB
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基于IIC通信的EEPROM读/写实验程序：
当按键1按下时，通过IIC总线执行AT24C02的数据写入操作；当按键2按下时，通过IIC总线执行AT24C02的数据读出操作；读写数据的地址一致，当执行读数据操作后，该数据将显示在数码管上。
文件中包括Verilog和VHDL的两种语言的Quartus II程序，请您参考。
2021-07-09 13:19:11
201KB
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