2021年的最新资源 Project4 FPGA完成MIPS微系统开发(支持设备与中断) 一、设计说明 1.MIPS 微系统应包括：MIPS处理器、系统桥和 1 个定时器，8 位 7 段数码管、32 位拨动开关。 2.MIPS处理器应实现MIPS-Lite3指令集。 a)MIPS-Lite3＝{MIPS-Lite2，ERET、MFC0、MTC0 }。 b)MIPS-Lite2＝{addu，subu，ori，lw，sw，beq，lui，addi，addiu，slt， j，jal，jr，lb，sb }。 c)addi应支持溢出，溢出标志写入寄存器$30中第0位。 3.MIPS处理器为多周期设计。 4.MIPS 微系统支持定时器硬件中断。 二、系统桥与设备 5.为了支持设备，MIPS 微系统需要配置系统桥。 a)需要支持 3 个设备，即定时器、8 位 7 段数码管、32 位拨动开关。 b)定时器的设计规范请参看《定时器设计规范.docx》。 c)实验设备中的 8 位 7 段数码管由 2 个 4 位 7段数码管组成。 三、FPGA 内置模块的使用 6.时钟定制电路 a)系统时钟为 100MHz

本资料包含有实验+试卷+自己复习时整理的试卷答案 实验有拍实验箱照片（实验为4.5绩点），但其实还是有些小瑕疵可能实验太难了老师比较仁慈，主要有以下实验 实验一 基础汇编语言程序设计，仅练习，不需提交报告网页 实验二 脱机运算器实验作业 实验f1 mux21a作业 实验f2 一位全加器作业 实验f3 正弦波发生器作业 实验f4a 8位12指令硬布线CPU设计作业 实验f4b 8位12指令微程序CPU设计作业 此资料有望成为广工计院师弟师妹计组复习与实验的救星

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北京工业大学2022计算机组成原理大作业logisim加报告，往届学长作业Logisim完成单周期处理器开发 一、设计说明 1.处理器应支持的指令集MIPS-Lite：addu，subu，ori，lw，sw，beq，lui，j。 a)addu，subu可以不支持实现溢出。 2.处理器为单周期设计。 二、设计要求 3.顶层设计视图包括如Figure1所示的部件，即Controller(控制器)、IFU(取指令单元)、GPR(通用寄存器组，也称为寄存器文件、寄存器堆)、ALU(算术逻辑单元)、DM(数据存储器)、EXT(扩展单元)、多路选择器及splitter。 a)顶层设计视图的顶层有效驱动信号包括且仅包括：clk、reset。 b)提示：图中的其他字符均不是端口信号。

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