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数字逻辑
数字时钟设计
报告
1.设计任务 设计制作一台数码显示管显示的数字钟。 2设计要求 ⑴时钟显示功能,能够以十进制显示“星期”、“时”、“分”、“秒”。 ⑵具有快速校准星期、时、分、秒的功能。 ⑶计时准确度,每天计时误差不超过1s。 ⑷整点自动报时,在离整点10s时,便自动发出鸣叫声,步长1s,每隔1s鸣叫一次,前四响是低音,最后一响为高音,最后一响结束为整点。
2021-09-13 13:56:15
1.06MB
数字时钟
1
基于VHDL的
数字时钟设计
这是vhdl设计
数字时钟设计
,包括如何除去抖动,怎样去设计时钟等等
2021-09-07 19:22:39
7.19MB
vhdl
数字时钟
1
多功能
数字时钟设计
资料全套设计及说明材料.zip
多功能
数字时钟设计
资料全套设计及说明材料
2021-08-07 14:05:42
302KB
数字时钟
数字时钟设计
采用电子线路的数字时钟的设计方案。使用74ls04,74ls20,74ls00,74ls 48,74ls160,八段数码管,ne555,晶振,等原件制成。附电路原理图以及pcb图
2021-07-20 17:02:21
2.75MB
数字时钟
电子线路
1
基于AT89C51的
数字时钟设计
单片机课程设计,是基于AT89C51单片机,有仿真电路图,以及用visio画的流程图。
2021-07-14 09:23:44
333KB
AT89C51
数字时钟
Proteus仿真
1
数字时钟设计
/数电设计报告
(1)由振荡器输出稳定的高频脉冲信号作为时间基准,经分频器输出标准的秒脉冲。 (2)秒计数器满60向分计数器进位,分计数器满60向小时计数器进位,小时计数 器按“12翻1”规律计数,计数器经译码器送到显示器。 (3)计数出现误差可用校时电路进行校时、校分、校秒。 (4) 具有可整点报时功能。 (5)具有定时闹钟的功能
2021-07-10 17:44:36
954KB
数字时钟设计
数电课设
1
基于Multisim的
数字时钟设计
为了提高电子电路实验教学质量,引入了Multisim仿真软件,以增加学生的学习兴趣。利用逻辑电路的设计方法,做了数字时钟的实验,得到了正确的结果。得到的结论:利用Multisim强大的功能对电子电路进行仿真测试,可以提高电路的设计和分析效率,提高电子电路实验的教学质量。
2021-07-08 08:56:10
82KB
Multisim
1
Multisim
数字时钟设计
实验报告
Multisim
数字时钟设计
实验报告,设计报告写得很详细,值得下!
2021-07-01 12:15:51
598KB
Multisim
数字时钟
实验报告
1
数字时钟设计
实验报告
数字时钟实验报告,数字时钟可以实现计时,整点报时,校正时钟功能。
2021-06-28 21:56:07
484KB
数字时钟
1
FPGA的
数字时钟设计
(VHDL语言编写)
时钟功能:完成分/时的正确计数并显示,由于数码管数目的限制,用发光二极管提示秒; 闹钟定时:可设置一组闹钟,并可在需要时将其关闭,利用二极管的发光代替扬声器的发声; 时钟校时:可以分别对分/时钟进行调整; 整点响铃:整点前十秒起发出提示音,利用二极管的发光代替扬声器的发声。
2021-06-28 14:59:15
19KB
FPGA的数字时钟设计(VHDL语言编写)
1
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