kaggle自行车大赛特征处理解析。
2022-05-07 16:58:00 592KB kaggle 特征处理
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集成电路作为半导体产业的核心,由于其技术复杂性,产业结构高度与业化。随着产 业规模的迅速扩张,产业竞争加剧,分工模式迚一步细化, 由原来的IDM为主逐渐转 变为Fabless+Foundry+OSAT。目前市场产业链为IC设计、IC制造和IC封装测试。核心环节中, IC设计处亍产业链上游 ,IC制造为中游环节,IC封装为下游环节。芯片设计分为前端设计(也称逡辑设计)和后端设计(也称物理设计),两者幵 没有统一严格的界陉,涉及到不工艺有关的设计就是后端设计。从设计程度上来 讲,前端设计的结果就是得到了芯片的门级网表电路。 EDA,是指电子设计自劢化( Electronic Design Aut
2022-05-07 16:13:34 5.1MB 3C电子 微纳电子 家电
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八路抢答器EDA课程设计VHDL 本文档是基于VHDL的八路抢答器的设计,经实验验证后程序准确无误。
2022-05-07 14:14:16 349KB 八路抢答器 VHDL
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EDA(VHDL)设计的交通灯毕业设计,经过调试检验能正常运行。源代码完整。
2022-05-07 08:23:56 411KB EDA 交通灯
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• 分数比例:教材第1~3章、后续章节各约占50%。 • 题型包括: • 填空题(1’×6+7×2’=20’) • 单选题(1’×20=20’) • 分析题(1-4题每题5分,第五题10分,共30分)  卡诺图化简,组合电路、时序电路分析  Verilog HDL编程:组合电路、时序电路 综合设计:Verilog HDL编程题(第1题10分,第2题20分,共30分) 组合电路模块、测试平台综合设计 FSM设计与实现
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1 本文件将正点原子领航者FPGA电路原理图全部重绘一遍,官方提供的电路图是PDF的,无法修改与编辑,本附件是ad格式的schdoc + 立创eda的json格式双份,带网络可以直接用,使用的时候可以直接复制到自己的ad或者立创eda即可,不需要重新绘制; 2 本文件修复了官方许多错误,官方的底板与核心板的网络是对不上的,本人将其全部改正,请放心服用; 3 本文件带完整的网络,但是封装只有一部分,请自己根据自己需求添加封装。
2022-05-06 18:02:12 515KB fpga开发 网络 schdoc ad原理图
运用集成电路的工作原理和使用方法,在单元电路的基础上进行小型数字系统设计,结合计算机仿真技术,利用数字电路的相关软件进行基础仿真,主要使用QuartusⅡ7.2软件对电路进行设计,并下载到SmartSOPC实验系统中进行硬件调试,以实现一个24小时数字计时器,可完成00:00:00~23:59:59的计时功能,并在控制电路的作用下具有清零、保持、快速校分、快速校时、整点报时功能、星期、闹钟、彩铃功能等。
2022-05-05 15:41:37 1.32MB EDA 数字钟 quatus2
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南昌大学eda实验报告
2022-05-05 09:04:53 2.12MB 南昌大学eda实验报告
EDA课程设计数字跑表
2022-05-05 09:04:52 2MB EDA课程设计数字跑表
EDA实验报告南昌大学讲解
2022-05-05 09:04:41 849KB EDA实验报告南昌大学讲解