广工数字逻辑与EDA设计组合逻辑电路实验报告

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0 引言 　　数字抢答器控制系统在现今许多工厂、学校和电视台等单位所举办的各种知识竞赛中起着不可替代的作用。基于EDA技术设计的电子抢答器，以其价格便宜、安全可靠、使用方便而受到了人们的普遍欢迎。本文以现场可编程逻辑器件(FPGA)为设计载体，以硬件描述语言VHDL为主要表达方式，以OuartusⅡ开发软件和GW48EDA开发系统为设计工具设计的电子抢答器，具有抢答鉴别与锁存功能以及60秒答题功能、对抢答犯规的小组进行警告和对各抢答小组进行相应的成绩加减操作等功能。 　　1 电子抢答器的功能 　　该电子抢答器实现的功能主要包括四项操作： 　　(1)抢答信号的鉴别和锁存 　　该电子抢答

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