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quartus II handbook volume1 - 2015.pdf

对于Altera芯片，对应的handbook非常重要，这里提供的是系列手册的第一部 volume1，主要讲解的是设计和综合。2015年版本

2022-01-11 17:14:06 23.54MB altera quartus intel

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32位CPU-Quartus代码完整版.rar

32位CPU-Quartus代码完整版

2022-01-10 09:08:48 27.63MB cpu verilog 计算机组成原理

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Quartus中fft ip core的使用

对于初学者学习FFT变换在Quartus中调用ip core的使用，是很基础的，尤其是做信息处理的朋友

2022-01-09 08:55:06 393KB Quartus fft

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基于quartus2的秒表实验

这是基于QUARTUS2的秒表实验，并用VHDL书写，已通过仿真，并下载到FPGA上也以通过。适合初学者学习分频等模块的设计。

2022-01-08 22:38:13 431KB VHDL quartus

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Quartus_18.1 安装教程

2022-01-07 23:04:13 223KB quartus

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数字频率计

与《集成电子技术基础教程》《电子技术综合实验教程》配套的数字频率计设计，基于Quartus和VHDL

2022-01-06 17:39:04 2.89MB 数字频率计 Quartus VHDL 仿真

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表决器Verilog源代码.zip

本设计是基于Quartus II 13.1 的Verilog编程代码，设计功能是三人表决器

2022-01-04 11:13:18 2.89MB Verilog FPGA 表决器 Quartus

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CPU设计（QuartusⅡ）

简单的CPU设计，采用QuartusⅡ软件实现。压缩包中有每个元件的设计，也有最终的CPU（压缩包中名为middle）

2021-12-30 13:44:48 1.7MB CPU，指令集， cpu设计quart cpu设计 quar

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基于vhdl实现基础交通灯控制电路，在fpga开发板上显示

2021-12-29 09:04:50 663KB verilog fpga quartus

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基于Quartus Ⅱ软件实现16位CPU的设计方案

CPU是广泛使用的串行数据通讯电路。本设计包含发送器、接收器和波特率发生器。设计应用EDA技术，基于FPGA/CPLD器件设计与实现CPU。本文利用Quartus Ⅱ软件仿真环境，基于FPGA(现场可编程门阵列)／CPLD(复杂可编程逻辑器件)设计与实现16位CPU的设计方案。

2021-12-28 15:08:36 358KB QUARTUS Ⅱ FPGA/CPLD CPU

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